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[問題求助] 求教 regulator 中ESD rule MOS該如何佈局才可以讓其功能達到最大

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1#
發表於 2009-10-20 14:20:24 | 只看該作者 回帖獎勵 |倒序瀏覽 |閱讀模式
5Chipcoin
如題
+ Z5 R; {( M. |% A, C請教前輩們 在LAYOUT regulator 時 其中有大量ESD MOS的佈局方式 該如何會比較恰當
0 t6 Z: q9 ]. [) M# E7 A
$ a  u$ g$ d# d5 W, b8 F0 `2 ?' Z然後又該注意哪些問題  因為我的w/l  30/0.3  現在再跑 POST- SIM.  發現到每個GATE 端電壓都不相同
( q( w/ @1 z, C( _- \$ |
$ m2 T: q0 [$ B2 C. e) r# }( U請問有哪位大大知道問題嗎  然後那個MOS 為M 228  感謝

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2#
 樓主| 發表於 2009-10-21 14:10:46 | 只看該作者
就此問題 已有解決的方法了5 y7 F# F. }/ B7 X* _% B" l
發現到 應該不是我的LAYOUT問題; L, ]5 x+ D& h* \4 M
應該是我打Label位置的問題 導致 RD在抽RC值 跑POST-SIM.出現
3 W; U% B/ ^6 ~8 `$ m6 p' O" V輸出訊號異常問題  重新標定過LABEL後 以解決此問題了 感謝1 A) }1 }1 e) V+ m/ k( E9 E
( i$ m3 J2 H0 m3 \, w

- L; E) K) D$ U$ [煩請站長將此案幫我做結案  感謝
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3#
發表於 2009-10-26 16:00:36 | 只看該作者
提示: 作者被禁止或刪除 內容自動屏蔽
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4#
發表於 2009-11-20 17:16:29 | 只看該作者
回復 2# clarkhuang . A1 z! W- ^0 T" z% P' a; w; X
2 H2 Q+ C+ {% m% j( G, i
; B3 P4 Y8 K+ s" g" e9 O9 t9 D( O
    下次在多注意一下就好
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5#
發表於 2009-11-20 17:18:09 | 只看該作者
LAYOUT要靠經驗的!!!加油! \5 j9 z& Z( @2 e/ D2 i7 u  _
LAYOUT要靠經驗的!!!加油
. Q: @1 i( G: M" N& N3 N" jLAYOUT要靠經驗的!!!加油/ C, k) K8 e3 o6 q: J  M* O5 ?
LAYOUT要靠經驗的!!!加油  n" F. H! o( }( q$ `! [) M% ]
LAYOUT要靠經驗的!!!加油
1 `& _7 L; s7 Q, F5 e, ^! ^- e/ j' QLAYOUT要靠經驗的!!!加油
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