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[問題求助] 請問TSMC 90nm DRC ERROR 麻煩了!感謝!

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1#
發表於 2009-9-20 16:20:14 | 只看該作者 回帖獎勵 |倒序瀏覽 |閱讀模式
由於之前都用CIC的虛擬製程.這是第一次用真的製程所以我完全沒有頭緒.請各位前輩幫幫忙.謝謝
# x; j1 H1 ]6 d2 d0 N1 P我LAY完一個子電路後跑DRC.但它出現以下幾個錯誤...(幾乎都是同一類錯誤.超多)
# z4 J3 |- \/ k6 S; ]( X1 R1.  DOD.R.1 {@ DOD is a must. DOD CAD layer must be different from OD's.
0 y/ V1 D5 j6 l  c# p* k                   CHIP_CHAMFERED NOT INTERACT DOD }
+ u4 Y0 Q  E& S, s9 ?! Y! `& e2. CSR.R.1.NWi {@ NWi is not allowed inside the empty area of chip corner.; k# x# C( B/ N* ]; y# `6 p( z3 Z
                   EMPTY_AREA AND NWi }
: N9 L: i, w4 F9 a6 u! e3. DUTM.R.1 {@ DUTM is must. The DUTM CAD layer must be different from the the UTM CAD 7 [( z' }- v% F2 v- Q& H
                     layer.
: t/ W0 H: I& {, a! }8 u                     CHIP_CHAMFERED NOT INTERACT DUUTM }
9 Z9 N) ~8 _; j1 ~, ~$ k7 D7 d. v3 w' q& H8 W+ e) W
麻煩了!
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2#
發表於 2009-9-21 13:54:35 | 只看該作者
2.是不能在角落的地方放layer & W# J, }8 p% t. O( ^
整體來看應該是 turn on ㄌ full chip check
; T; Z2 I8 O1 u% I# Q0 h在 DRC command file 先把它 mark 掉 & `0 x1 [9 n- ?) v2 V: {
在 whole chip 時再來 RUN 會比較清楚些* D: g+ i" Z0 v. X: ?7 @" U! A" v7 O+ X
////#DEFINE FULL_CHIP" |( }. ]- w5 W( ~, m9 l
仔細研究一下 design rule
8 d0 h- o7 F# r應該會有幫助
3#
 樓主| 發表於 2009-9-21 22:29:31 | 只看該作者
恩!!!感謝m大!!原來還可以改DRC command file 喔!!請問要怎麼mark掉?
4 J3 j2 u& k  {6 G9 q7 n, N" W, U. {還有DRC command file是指那個file,就是跑drc那個file嗎?
  e8 x" I, h( b1 O' Y' `7 W
% h. ]3 I, |# f: f8 L# G還有再請問一個題外話!在畫MOS時.利用finger將mos的width / m6 |3 D& O- a/ s) `
變小.跟不用finger,width很大.有什麼差?如果不考慮noise' V7 }" ^% b2 J, t7 T! f
也不是RFMOS.那這樣除了寄生電容稍大還會有什麼不好的?& ^3 |8 J$ _; i5 `1 X
0 k% D9 W1 n' v/ ^/ @3 ^. W- l
[ 本帖最後由 henry90176 於 2009-9-21 10:31 PM 編輯 ]
4#
發表於 2009-9-22 14:31:03 | 只看該作者
恩!!!感謝m大!!原來還可以改DRC command file 喔!!請問要怎麼mark掉( e8 m6 V% M7 w
就是在這行 //#DEFINE FULL_CHIP
% b" D, k) w3 G8 h* E在前面加 2 個 // 那行就被mark 不會被執行 (卡利柏驗證軟體)
8 }! }7 V( ~) F如果是吸血鬼驗證軟體 就是在前面加一個分號  ;
7 a) G* Q' h- v/ N% F2 s$ l  I+ h 還有DRC command file是指那個file,就是跑drc那個file嗎?
. f, q, k, |% P( k8 L. M是的  有人說  rule file 也有人說  command file
7 D4 [. J& _. I, O$ G8 J# z& `4 R! F2 s
還有再請問一個題外話!在畫MOS時.利用finger將mos的width :
# r5 m, H* A. }變小.跟不用finger,width很大.有什麼差?如果不考慮noise- T3 }& S- q; C) [8 S$ B
  也不是RFMOS.那這樣除了寄生電容稍大還會有什麼不好的?
! ?! `& k1 z' f- x沒瞎密差,也沒瞎密不好 通常是以整體考慮 % A- L7 a9 S/ E1 s8 ^, {
例如 整排都是 w=5   只有 一個 w=20  那就是 鶴立雞群ㄌ; u7 r1 y' ?  A
通常會做成 finger 4  統整高度, 這類問題會先和 designer 討論
" s& U4 S5 W% c. K+ B4 O0 r9 Y0 n後 做決定 有時電路有其考量  參考參考
! P- H# n* r6 P4 Y! e; a
; l" W' I. J, t4 o5 c:
5#
 樓主| 發表於 2009-9-22 19:18:00 | 只看該作者
真的很感謝M大!!問題大概解決了!!謝謝~~~!!!!!!!!
6#
發表於 2009-10-20 00:04:44 | 只看該作者
我知道卡利柏驗證軟體指的是calibre吧~
& j* [  `4 y7 @; B那可以請問一下吸血鬼驗証軟體是…!!?
7#
發表於 2009-10-21 14:48:26 | 只看該作者
原帖由 小包 於 2009-10-20 12:04 AM 發表 ! u$ O6 Z4 a" \$ r* G+ x
我知道卡利柏驗證軟體指的是calibre吧~
' c& m1 j) z3 d: W' T& I' S那可以請問一下吸血鬼驗証軟體是…!!?
<<<<<沒記錯 virtuoso都是內建的DRACULA
8#
發表於 2009-10-22 22:58:07 | 只看該作者

回復 7# 的帖子

哈哈哈…所以吸血驗証軟體指的是dracula嗎!!?
9 d. o. Y2 d% e+ V8 q) O* E原來我一直在用的就是吸血驗証軟體…
% C0 H+ B' l) ~1 f  p- P2 Z. Z- M這個名稱還滿好笑的……
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