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[問題求助] 關於layout連接

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1#
發表於 2009-8-4 00:49:25 | 顯示全部樓層 回帖獎勵 |倒序瀏覽 |閱讀模式
各位大大好% `; v( z. o7 T0 \2 Y
我遇到了一個問題是有關於把兩個block連起來後,LVS卻遲遲無法通過(我有把兩個的vdd和gnd用metal連起來)4 c* }$ j/ `# X8 a, Z( W+ {: R3 W  g
個別把兩個做LVS是正常的 但接起來後卻一直跑出錯誤  更糟糕的是還不少  但都是一些頗怪的地方/ B2 H+ Q5 ]0 u: `  S
譬如說  原本一個BLOCK跑過的地方去無緣無故出現錯誤  但線路是對的
/ ^/ @" g. r- Y還有MOS找不到instance  實在是無法理解
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2#
 樓主| 發表於 2009-8-5 18:54:49 | 顯示全部樓層
我找到問題所在了  因為兩個block裡面都有名稱一樣的cell(一個是INV,另一個是inv)
+ D+ d5 R6 A5 H2 K; t難怪會有那種無解的錯  所以名稱也得特別小心阿   有了這種不小心之後  希望大家也能夠多注意囉, M  g! v# F) d4 r1 U
名稱還是不要打一樣的好  呵呵
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