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Chip123 科技應用創新平台»論壇 › Chip1 -- 基礎元件 › Layout設計討論區 › p+ poly電阻圍nwell的用意？

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[問題求助] p+ poly電阻圍nwell的用意？

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發表於 2009-6-24 14:58:20 | 顯示全部樓層

发表下不同意见哈：

我认为应该接低电位，但是一定要从pad直接拉过来的低电位，就是因为高电位很难找到，如13楼所说。接高电位，弄不好隔离环变成干扰源啦……

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