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不知道在這裡問對不對,請問一下,下面這個 書上的 "hello verilog" 例子在modelsim環境下怎麼下command才能link 並且可以產生結果呢
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看usermannual 的語法說明不太了解 不知道哪位大大可以告知一下呢 先謝謝各位了- c, H* V- ^, _$ g/ {
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#include "veriuser.h" /*include the file provided in the release dir */! U! p& n- e, h: {4 d1 |
6 @8 M; O N- I9 Iint hello_verilog()
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io_printf("Hello Verilog World\n";" p0 i/ \& F5 ^& n) a
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