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Chip123 科技應用創新平台»論壇 › Chip1 -- 基礎元件 › FPGA/CPLD/ASIC討論區 › verilog 想做一個timer
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[問題求助] verilog 想做一個timer

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tescoq
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1#
發表於 2008-11-2 14:27:23 | 只看該作者 回帖獎勵 |倒序瀏覽 |閱讀模式
如果我做一個carpark timer, 每3秒就$1, 之後每8秒$1
/ c, I; _& ^+ k; i% Pusing verilog
3 q8 V7 I  y+ T( C9 |8 ]% `! a. W# E7 ?7 [請問可以點寫?; ]$ [$ G0 y7 G% V) s7 k% C0 y) n

' g( `3 U6 e2 n* ~' t[ 本帖最後由 tescoq 於 2008-11-2 02:40 PM 編輯 ]
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2#
發表於 2008-12-1 10:48:03 | 只看該作者
if you have the passion ....9 f6 K7 X! `+ z6 h: c# t
let's ok
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