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[問題求助] 求助关于GCPMOS管的版图

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1#
發表於 2008-12-18 14:24:38 | 只看該作者 回帖獎勵 |倒序瀏覽 |閱讀模式
如果GCNMOS管做电源的CLAMP电路,drain连接到电源上,source连接到地,很好理解,drain到POLY距离拉大,能减少电源电流对poly的冲击
- n6 n2 U. M/ V3 m而对于GCPMOS管做电源的CLAMP电路,drain(到POLY的距离更大的有源区)是否也应该连到电源哪?6 o) O$ J2 o0 n1 Q( {' F" t) i7 h
谢谢
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2#
發表於 2008-12-18 18:05:25 | 只看該作者
你是否想用GCNMOS? 我們很少用PMOS 通電,因為它的BJT gain是很低
. K) O- v" ?0 H+ |3 e如果是用NMOS的話,drain 是連接到power, source 是連接到ground.
3#
發表於 2008-12-18 18:08:40 | 只看該作者
GCPMOS比较费面积!画小了不起作用
4#
 樓主| 發表於 2008-12-19 09:28:02 | 只看該作者
我现在用得这个工艺,foundry推荐用GCPMOS的,但是不知道版图上drain和source怎么处理?: H: h% [5 o; u, ?+ U0 m" \
5 [0 {; }) B/ x4 B5 h
[ 本帖最後由 scy8080 於 2008-12-19 09:52 AM 編輯 ]
5#
發表於 2008-12-19 16:25:15 | 只看該作者
就像GCNMOS一样处理吧!
6#
 樓主| 發表於 2008-12-19 17:07:42 | 只看該作者
drain(到POLY的距离更大的有源区)是连到电源还是连接到地好?能否给个解释?谢谢
7#
發表於 2008-12-29 17:23:37 | 只看該作者
drain是要連到正電源 (assume product 沒有負電壓), body / source 就連接到 VSS
6 i, ~% o! Y  L$ ~當正ESD pulse打到正電源,它會透過NMOS內的parasitic BJT把電流流到 grounded pin
8#
 樓主| 發表於 2009-1-4 15:10:30 | 只看該作者
我想知道的是PMOS管的情况!!!2 D- z7 H. G/ L1 j& q4 k# f: g5 r

# j+ O0 A  v% s& B  B对于反相器,通常情况,我们认为pMOS管连到电源的有源区为source,连接到输出的为漏;
% p& M8 X% ?4 s9 d8 T
  |$ Y4 W1 `0 w7 C3 n' D- C0 C: x7 dGCNMOS的clamp电路,drain连接到正电源,body/source接到VSS,正ESD pulse打到电源,NMOS的寄生BJT导通使ESD电流到地 pin,
$ s  s; j. `) Z. A& k% C) f, ?而对于GCPMOS管的clamp电路,应该如何考虑?
9#
發表於 2009-1-10 00:37:37 | 只看該作者
我想是這樣子吧~
( x: o$ O6 d# P* p2 j0 r7 ~/ L3 NNWell Process + Psub, NWell 便要連接到正電源,PMOS drain連接地pin
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