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Chip123 科技應用創新平台»論壇 › Chip1 -- 基礎元件 › Layout設計討論區 › 在Layout時最花時間的工作是....
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樓主: jauylmz
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在Layout時最花時間的工作是....

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samgu
21#
發表於 2007-12-25 09:32:04 | 只看該作者
1.我也認為 floor plan 最麻煩，因為一個好的 floor plan 除了能讓訊號線走的順之外，也可以節省面積. X- ~0 i4 Z) i8 T7 s8 q; U2 b4 p
2.接下來我覺得比較重要的是 power and ground line 的跑線，因為要走的順才是最重要的，而且若POWER途中一直換線其實也會降低它的電流
7 _: h; h0 r4 f  y( F3.接下來我覺得都還好，因為 DRC LVS block 刻好就會 RUN 了 ，另外create block本來就需要花一點時間
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22#
發表於 2007-12-25 11:52:01 | 只看該作者
如果位置沒有排列好ㄉ話！面積會變大∼甚至拉線會亂七八糟ㄉ∼
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yhchang
23#
發表於 2008-1-27 11:14:54 | 只看該作者
最花時間的應該是  給你的空間不夠. b; ?" f  ~+ E; w/ m- W3 ]5 k
你勉強把東西 塞進去之後  好不容易做完7 m" b6 V' E6 I9 k- I
結果電路圖又變了  你就完了
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yhchang
24#
發表於 2008-2-5 20:17:01 | 只看該作者
以我們公司來說. O, y4 ?0 ?1 h( B5 i" l
一直改圖對LAYOUT來說是最花時間的. l+ q$ H& N" s$ ]
或者是 沒有看清楚 RD寫的NOTE
% n0 |6 o/ D4 q& Y! Z' y導致LAYOUT雖然能過LVS 但是LAY法卻是錯誤的4 F, k5 J) V% v( i! ~) B) }. c

" [6 [! Q; j" {8 b0 j% _有時候我們公司RD也不想讓LAYOUT一直改
9 c5 A2 G: y0 a8 [# E只是因為有時專案太趕2 i# w+ ^6 }9 t* F0 v/ m
所以只好跟LAYOUT同時平行做
4 b4 d: e) F7 Z$ f% {這樣就容易電路常常會大翻盤
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qwertmn
25#
發表於 2008-3-19 13:01:26 | 只看該作者
我是選擇排列~~~* i0 h) ^9 [! C2 U- K- b) n6 O+ l
光是排列就會影響後續走線( i! L+ ?- f' F' C3 n  c
所以要特別注意~~~
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ynru12
26#
發表於 2008-3-25 09:49:52 | 只看該作者
元件的排列、拉線都會有很多要求之類的
( z/ \, @4 h" `最辛苦的就是改圖~原本己經畫好的，但是rd突然說要改圖5 L# K% B! O" d# C, F. ?$ h3 I& H
然後整個的大小不變，但是改的地方，又比原來的大一些1 h0 }# I! \4 w" q
這是最麻煩最痛苦的
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27#
發表於 2008-5-26 22:19:14 | 只看該作者
Re-layout往往是floorplan做得不好，所以floorplan是很重要。
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jauylmz
28#
 樓主| 發表於 2008-7-9 18:34:24 | 只看該作者
Chip Integration    可以算是拉線和DRC/LVS 嗎
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29#
發表於 2008-9-9 09:36:20 | 只看該作者
其實上述所有選項都基於兩個字 : "溝通".如果與designer溝通不良,即使畫的像藝術品一樣,花的在久精神部局與除錯,只要designer說不是他要的,一切枉然,全部重來.
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30#
發表於 2008-9-10 14:56:03 | 只看該作者
以上皆非( Y# m, b. `: _$ Q+ I

  F3 j+ t( g5 U! }  S( u我花最多時間的是在思考，' c" \' O7 }" ?
一個5天該完成的案子，我可能會花去2~3天思考。
3 `  a. x8 r$ J! x  J事前想的仔細，+ O$ j; L1 `  c: \* s4 e- s
開始動手layout一直到驗證完成都會很快而且順利。
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fei
31#
發表於 2008-10-23 16:34:30 | 只看該作者
都很耗時間!!!  只要 動手 下去做  都是 耗時間!!!  哈哈~~~  用呼叫的 自動拉線  才是王道~~
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32#
發表於 2008-10-27 17:07:49 | 只看該作者
布局和整合最难，最能体现实力！。。。。。。。。。。。。。。。
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sj1130
33#
發表於 2008-11-9 00:01:28 | 只看該作者
我也認為排列的部分還是會花費較久的時間，可能是因為剛接觸Layout沒多久，經驗不足顯得更無力！
; X2 T. E0 }5 j整合這部份，如果是自己獨立一人完成，雖然時間耗費較多，但是就跟寫程式一樣，如何去安排自己的line能走得順
+ w" f' |& j, k我想這才是最重要的！重點一句：還是經驗比較實際吧
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34#
發表於 2008-11-18 11:04:16 | 只看該作者
有不花時間的嗎
4 E5 b2 g4 }1 sLAYOUT我覺得每項都很花時間
) H# ^. S, z8 S9 T; m不管是佈局還是LVS/DRC
# G  b# [4 `; B% B8 [每項都得小心翼翼; @1 @3 `3 U- e4 L' f
做快不見得好4 o" {2 a2 N! e
做對才是重要
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app
35#
發表於 2009-4-9 01:03:28 | 只看該作者
我也覺得 floor plan 最麻煩~
  R* a# j5 o' [9 v* c因要如何將每個block充分擺到適當的位子~
1 G! ~6 q  w, Z/ n這是一種學問~, |) c- a' E6 V1 Q! A9 L% t
因擺的好的話~7 T' _/ H  k$ Y6 |1 ]
其他的閃線或拉power一切都還滿ok的
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36#
發表於 2009-4-24 13:19:48 | 只看該作者
2.  排列 Placement   
' W, D( j$ K. F' f6.  整合 Chip Integration$ W; a. |, p, [$ F  ]% G+ V* c1 h
7.  溝通 communication8 e. t0 S# P, |, P+ `0 l2 ~
這三個最麻煩
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brooo
37#
發表於 2009-6-27 01:02:39 | 只看該作者
排列最花時間吧" a$ k6 m5 H4 X; l: n" ^) ^
* n) }1 f4 X8 Z/ Y% D1 {2 L$ i
在layout初期就要花很多時間先想好如何排列
% l0 Q& P% o# g+ ?* D" h
& U4 R3 G, w' \, M3 `, c想好後，反而才會省下大量的時間
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AaronChu
38#
發表於 2009-7-4 12:07:08 | 只看該作者
位置該怎麼擺真的需要一開始的計畫...
- [* Q7 i6 v" e要不然最後會發生難以挽回的錯誤啊>.<
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39#
發表於 2009-7-8 11:56:51 | 只看該作者
floor  plan比較花時間  只要floor plan 做好   ; Y8 m; C$ T4 K4 S
- @" L* {: ~/ ^
其他就會很快   相對LVS 問題也比較好除錯
: |8 D! i! t/ Z4 ~, t) J# s% l' z5 I9 R6 W5 E2 _
HR.概念有  應該DRC LVS比較不會有問題吧
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kevinpu
40#
發表於 2009-9-3 09:08:46 | 只看該作者
我覺得placement和溝通是花最多時間的,因為會決定你的做法和拉線的容易度,
7 j$ P% u/ L& D( G7 ?$ Q. g$ [' M; e再整合時也會是另一個問題
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