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加速SoC軟體開發時程

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1#
發表於 2007-10-3 01:26:46 | 只看該作者 回帖獎勵 |倒序瀏覽 |閱讀模式
加速SoC軟體開發時程    # u: |  U" c* K  g* I

) Y2 w, {0 d2 e# B; D隨著SoC設計日漸複雜,時脈速度不斷攀升,加上內建愈來愈多的功能,工程師必須在晶片開發週期中儘早取得設計平台。儘早發展出代表整體設計的原型方案,能早在硬體完成設計之前,就展開費時的軟體設計程序。此種平台運用創新的模式來隔離軟、硬體的設計,並簡化不同廠商IP的整合工作,大幅加快軟體設計流程。  + _5 B- y6 y; {8 z, k

2 Q; g+ `+ D2 R- L- l過去,邏輯驗證是大多數SoC研發業者所遇到的瓶頸。因為SoC電路設計的快速攀升,讓硬體驗證工作的複雜度呈現急速激增的現象。
, h8 }% E, ?9 X1 l. R: Z# G
/ T6 s7 `3 f5 ?" `現在,嵌入式軟體研發則是SoC研發業者在開發流程中所面臨的最大挑戰。目前SoC有超過五成的成本是使用在開發趨動程式、開機程式碼、與硬體相關的通訊協定堆疊、DSP演算法及其他嵌入式軟體。隨著軟體在新世代的設計中扮演愈來愈重要的角色,業者花在軟體上的成本也會愈來愈多,如(圖一)所示。
6 b+ {$ u6 w2 \( z, R0 q
4 }* x* T4 N& K+ k$ h' I$ Z% b) }  K0 t. m& U8 [8 Z
" E$ A& N- E$ t; J9 Z% J) d% D
《圖一 業者花在軟體上的成本愈來愈多》: i" u1 [/ k" b# n: c; h
" Y$ T6 ~9 r+ D' m) ^" N: z9 m
SoC所面臨的難題,主要是實際晶片的開發與相關軟體設計兩者之間所存在的時間差問題。傳統的SoC軟體研發業者,必須等到硬體研發團隊設計出實體的原型元件後,才有可供參考的硬體環境。因此,軟體研發必須等到硬體工程師設計出完美的元件後才能動工。隨著市場上產品生命週期的縮短,以及激烈的競爭壓力,研發流程延遲不僅只是成本增加,更會影響產品獲利。# k, q3 {1 |! I) d# |( u

1 `' G' e9 W3 H0 s$ ^  HSoC研發業者需要的是能減低這種在軟、硬體設計上循序式進行的全新研發策略。這個策略可讓SoC研發業者能快速的將通過驗證的硬體IP整合到可量產的硬體核心系統。此外,它必須能建構在開放式架構上,讓SoC研發業者能很容易的將這些不同的IP供應商所推出最頂級的IP元件緊密整合到其設計中。最後,藉由同步的軟、硬體設計,能讓SoC研發業者在硬體設計完成之前,提早進行軟體撰寫與除錯作業,進而大幅減少研發成本與縮短上市時程。- X+ p4 e+ ^8 u8 Z5 v4 _

" U4 I" S& R; s7 J5 y  y
遊客,如果您要查看本帖隱藏內容請回復

& L% p% [/ b, z" t1 r% h
2 n; V: C! ~8 W* [[ 本帖最後由 masonchung 於 2008-4-21 06:37 PM 編輯 ]

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2#
發表於 2007-10-3 09:46:12 | 只看該作者
感謝好文分享
! G% x4 J1 H$ a+ O: W9 @8 q% X' @, K5 S+ @" N! \- `/ w4 s
但看不到圖?
3#
 樓主| 發表於 2007-10-3 22:26:28 | 只看該作者
圖上傳囉
4#
發表於 2007-10-9 11:09:59 | 只看該作者
感謝提供好文章
/ i8 I. N9 }& S- G  \( V讓大家可以互相學習
5#
發表於 2008-1-29 20:18:38 | 只看該作者
SOC比起一般的ASIC驗證開發而言,不論其複雜度、人力與時間成本高出不少。
' g- y/ P, U0 z4 u/ ~/ e- y5 }. m目前大致上都會在RTL與FPGA階段去做軟體的驗證,如果信心度要高一點的話,連RTOS也需一併在FPGA驗證,比較起來是有其難度。1 n; ^& R1 F0 D* R- m3 e- I
& p, n1 b. T/ I+ I' g
如果可以縮短開發時程的話,Time-to-Market的時效性也就能有所增進。) L- D2 y5 `6 w& r& b4 {4 t
SystemC或許可以改善部分的SOC系統驗證的效率性,但還有更加有效又經濟的加速開發SOC的方式嗎?

評分

參與人數 1 +3 收起 理由
masonchung + 3 Platform based design tools support HW/S

查看全部評分

6#
發表於 2008-1-30 09:18:56 | 只看該作者
最後,藉由同步的軟、硬體設計,能讓SoC研發業者在硬體設計完成之前,提早進行軟體撰寫與除錯作業,進而大幅減少研發成本與縮短上市時程。( ?( l, L& ?4 x; w: f: `0 \& m
這句話若真的實現我應該會大呼傑克,這真是太神奇了:j 9 T9 U  x3 o7 j5 N6 \

3 X7 f+ b6 L- ^# m實現後可能視情況修改軟體1/3吧,新技術的硬體可能高達2/3@@  猜的~

評分

參與人數 1 +3 收起 理由
masonchung + 3 The key point is ESL design

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7#
發表於 2008-1-30 10:18:22 | 只看該作者
有人戲謔: 做SoC的IC designer越來越像"接線生"---僅將IP連線整合
8 j6 T$ d) s+ {1 _! C2 H而firmware/software engineer越來越有發揮的空間
8#
 樓主| 發表於 2008-1-30 13:52:16 | 只看該作者

回復 7# 的帖子

SOC IC designer not really the line operator, he had much of  tech. knowledge need to integrate these ip and design new fuction block with all.
9#
發表於 2008-2-8 00:18:57 | 只看該作者
讓我看看這個圖片                        啊
10#
發表於 2008-2-8 00:22:54 | 只看該作者
樓主既然分享,             圖片干嘛還要收費         啊????
11#
 樓主| 發表於 2008-2-8 00:33:40 | 只看該作者
沒有收費,請看清楚喔
, k! ?2 p- P9 B/ s* V回覆讓你賺RDB不好嗎?
( M# `1 v6 E$ h* k
& [# T3 q. i7 `0 y- Y: @[ 本帖最後由 masonchung 於 2008-2-8 12:34 AM 編輯 ]
12#
發表於 2008-2-8 14:49:24 | 只看該作者
I'd like to take a look at this article.8 R; V3 ^7 h  |5 S  H0 @4 R/ s

2 ?1 J6 F. R; u/ j! Q% e! hThanks.
  _: Y9 U8 _9 dJonson
13#
發表於 2008-2-11 20:16:34 | 只看該作者
感謝提供好文~小弟不才來學習學習~十分感謝~
14#
發表於 2008-2-11 22:09:10 | 只看該作者
評台設計好就會有客戶買賣這樣生意就可坐起來) i0 k" W& H( `! e7 F
哀~ 工作快來找我 >"<
15#
發表於 2008-2-13 14:17:10 | 只看該作者
thanks you for share ; {# N+ C. U' _6 i4 [6 T
so hope you post more good post
16#
發表於 2008-3-6 22:54:02 | 只看該作者
firmware/software engineer越來越有發揮的空間了.....( I! P: @+ N3 t! R! o# S; Y9 U
加油!!
17#
發表於 2008-3-7 12:18:33 | 只看該作者
system驗證越來越複雜. thanks for sharing, 參考看看.
18#
發表於 2008-3-11 09:24:39 | 只看該作者

回復 1# 的帖子

Thanks for the sharing, very good piece.
19#
發表於 2008-3-11 23:03:14 | 只看該作者
SoC嵌入软件开发的比重越来越大,如何加快嵌入软件的开发满足市场的压力确实是目前的挑战。
20#
發表於 2008-4-15 17:15:34 | 只看該作者
SystemC是不是未來的解決方案呢?! 9 r/ {$ V  z$ b0 N, E
希望這篇文章能讓我gain something
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