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Chip123 科技應用創新平台»論壇 › Chip1 -- 基礎元件 › Layout設計討論區 › 在Layout時最花時間的工作是....
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樓主: jauylmz
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在Layout時最花時間的工作是....

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samgu
21#
發表於 2007-12-25 09:32:04 | 只看該作者
1.我也認為 floor plan 最麻煩，因為一個好的 floor plan 除了能讓訊號線走的順之外，也可以節省面積- e$ ~& g8 d& h) |# P
2.接下來我覺得比較重要的是 power and ground line 的跑線，因為要走的順才是最重要的，而且若POWER途中一直換線其實也會降低它的電流" u  k* Y2 m3 B6 L* Y3 \) ^
3.接下來我覺得都還好，因為 DRC LVS block 刻好就會 RUN 了 ，另外create block本來就需要花一點時間
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22#
發表於 2007-12-25 11:52:01 | 只看該作者
如果位置沒有排列好ㄉ話！面積會變大∼甚至拉線會亂七八糟ㄉ∼
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yhchang
23#
發表於 2008-1-27 11:14:54 | 只看該作者
最花時間的應該是  給你的空間不夠
: ~+ P8 {, K  O) T7 _你勉強把東西 塞進去之後  好不容易做完
3 Y3 ?% Q  A4 Y+ X! V結果電路圖又變了  你就完了
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yhchang
24#
發表於 2008-2-5 20:17:01 | 只看該作者
以我們公司來說
1 V' h3 v) N4 D& ?$ G3 S% I一直改圖對LAYOUT來說是最花時間的
' d# q; t! X+ C5 ?; ~* c0 V4 x或者是 沒有看清楚 RD寫的NOTE1 N. f1 f' @$ j# F% B# R. _
導致LAYOUT雖然能過LVS 但是LAY法卻是錯誤的. J6 q! D- f; r8 ]
+ N0 j/ o6 d. {  T% S
有時候我們公司RD也不想讓LAYOUT一直改2 ]1 `0 {9 ^. M' ^4 _& {
只是因為有時專案太趕% D% ?, l+ J# t# f
所以只好跟LAYOUT同時平行做
0 s0 d+ O+ |2 d, L; q7 }2 f這樣就容易電路常常會大翻盤
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qwertmn
25#
發表於 2008-3-19 13:01:26 | 只看該作者
我是選擇排列~~~2 B+ [% v- b8 h6 z
光是排列就會影響後續走線" L" I% b8 ~+ z- B
所以要特別注意~~~
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ynru12
26#
發表於 2008-3-25 09:49:52 | 只看該作者
元件的排列、拉線都會有很多要求之類的  a+ i# W/ E% k6 E/ V1 G
最辛苦的就是改圖~原本己經畫好的，但是rd突然說要改圖
3 e+ A4 n. f( U; j, @9 |# A然後整個的大小不變，但是改的地方，又比原來的大一些" g+ \0 S2 e4 X: Y" N/ j
這是最麻煩最痛苦的
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27#
發表於 2008-5-26 22:19:14 | 只看該作者
Re-layout往往是floorplan做得不好，所以floorplan是很重要。
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jauylmz
28#
 樓主| 發表於 2008-7-9 18:34:24 | 只看該作者
Chip Integration    可以算是拉線和DRC/LVS 嗎
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29#
發表於 2008-9-9 09:36:20 | 只看該作者
其實上述所有選項都基於兩個字 : "溝通".如果與designer溝通不良,即使畫的像藝術品一樣,花的在久精神部局與除錯,只要designer說不是他要的,一切枉然,全部重來.
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30#
發表於 2008-9-10 14:56:03 | 只看該作者
以上皆非( y/ T1 `* F3 n# I) _
% D8 [+ q1 b: t7 F
我花最多時間的是在思考，+ P% P: }$ N: |, b% U
一個5天該完成的案子，我可能會花去2~3天思考。
; K7 t* ^& z, X事前想的仔細，  @- a8 R* K) F0 L2 K3 A
開始動手layout一直到驗證完成都會很快而且順利。
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fei
31#
發表於 2008-10-23 16:34:30 | 只看該作者
都很耗時間!!!  只要 動手 下去做  都是 耗時間!!!  哈哈~~~  用呼叫的 自動拉線  才是王道~~
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32#
發表於 2008-10-27 17:07:49 | 只看該作者
布局和整合最难，最能体现实力！。。。。。。。。。。。。。。。
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sj1130
33#
發表於 2008-11-9 00:01:28 | 只看該作者
我也認為排列的部分還是會花費較久的時間，可能是因為剛接觸Layout沒多久，經驗不足顯得更無力！
0 c5 k: A% G4 n& D" E整合這部份，如果是自己獨立一人完成，雖然時間耗費較多，但是就跟寫程式一樣，如何去安排自己的line能走得順
2 ]  f" e0 m5 o! o6 J1 c我想這才是最重要的！重點一句：還是經驗比較實際吧
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34#
發表於 2008-11-18 11:04:16 | 只看該作者
有不花時間的嗎1 t& ^$ C, U3 J+ f' s
LAYOUT我覺得每項都很花時間
! n0 o# s* [' A8 Z. O- Z: N5 k不管是佈局還是LVS/DRC, G( B+ g8 r3 ?! ?1 f4 f
每項都得小心翼翼9 F- B, Z" S6 g' K) D. m4 z
做快不見得好
4 D8 {+ g3 x5 e1 f- g9 w做對才是重要
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app
35#
發表於 2009-4-9 01:03:28 | 只看該作者
我也覺得 floor plan 最麻煩~  M' D) |! ~8 g4 E3 B9 Y
因要如何將每個block充分擺到適當的位子~
# z- l0 w0 M; o  s這是一種學問~
6 O% H& R( r+ ^, z) Y) X1 Y* |因擺的好的話~+ N9 z- g0 w6 g
其他的閃線或拉power一切都還滿ok的
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36#
發表於 2009-4-24 13:19:48 | 只看該作者
2.  排列 Placement   
+ ]  }. p7 l2 K$ I  J( B6.  整合 Chip Integration, _# m4 [( T7 X" `; V
7.  溝通 communication
$ ^5 A4 B& }, Q6 T# _/ T$ f這三個最麻煩
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brooo
37#
發表於 2009-6-27 01:02:39 | 只看該作者
排列最花時間吧; m! C$ i, H2 b! Y- L) `* x9 ]( I
5 G0 e4 _6 m- j' M% P* s
在layout初期就要花很多時間先想好如何排列
, {# Q6 I) d& F& m! _1 j+ @+ ~  z& P. O  V0 v9 y1 l
想好後，反而才會省下大量的時間
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AaronChu
38#
發表於 2009-7-4 12:07:08 | 只看該作者
位置該怎麼擺真的需要一開始的計畫...
/ h' [! w2 N1 F% v9 ~3 C+ N要不然最後會發生難以挽回的錯誤啊>.<
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39#
發表於 2009-7-8 11:56:51 | 只看該作者
floor  plan比較花時間  只要floor plan 做好   5 R* [! o/ N9 p$ t
7 L! o8 m4 Z" f4 I3 N) y3 O0 ~% I5 y
其他就會很快   相對LVS 問題也比較好除錯
4 b; ]& B/ s* H2 q! W3 X# R( }/ ]1 j: F
HR.概念有  應該DRC LVS比較不會有問題吧
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kevinpu
40#
發表於 2009-9-3 09:08:46 | 只看該作者
我覺得placement和溝通是花最多時間的,因為會決定你的做法和拉線的容易度,# k- N9 Q: v8 n# q* Z
再整合時也會是另一個問題
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