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Chip123 科技應用創新平台»論壇 › Chip1 -- 基礎元件 › FPGA/CPLD/ASIC討論區 › 請問xc2v4000+(FPGA)
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[問題求助] 請問xc2v4000+(FPGA)

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1#
發表於 2007-5-20 18:14:33 | 只看該作者 回帖獎勵 |倒序瀏覽 |閱讀模式
請問燒錄到FPGA和FLASH有什麼要注意的分別嗎?都是用同一個bit檔嗎?: C( A) |# n3 Q- d6 y& {
3 c& l# r2 n" S( ]2 d$ P6 s/ l
還有就是說如果flash內已經有之前的燒錄檔了,納現再我要在灌一個新的怎麼辦?他會直接覆蓋過去嗎?

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2#
發表於 2007-5-20 18:32:36 | 只看該作者
FPGA直接燒錄的話如果重開機, 就要再燒一次
8 D+ ?! a( a2 o6 r4 A  |( {7 L如果是燒到flash的話 每次開機就會從flash讀到fpga
5 w0 s5 {) z7 j& J0 u. l7 SFPGA就不用重燒啦0 U: Z# f4 R/ G; }" h! Z) q

, T& X! v& H5 A( s5 y, w燒到flash 和FPGA的電路檔相同 ,但是要燒到flash必須先燒一個flash 載入的控制電路到FPGA
# W: A% R$ G7 L% n( E" M
" N, t) J# s$ @' e# e6 O  z燒到flash的電路檔 只要位址沒有重複應該不會被蓋掉
, c$ m" x% ^$ j( F& s, ]+ G8 F0 Y& S4 {: N
[ 本帖最後由 masonchung 於 2007-5-20 06:36 PM 編輯 ]

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3#
 樓主| 發表於 2007-5-20 19:32:20 | 只看該作者
你說燒到flash必須先燒一個flash的載入的控制電路?8 V; l2 T4 o1 I3 |4 f: U+ n
那我要去哪邊取得阿?
1 k- E+ `# P) a) ?
# o( b; [  N: i0 j* {" l我ㄉ型號是xc2v6000(4000+)
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4#
發表於 2007-5-20 19:56:35 | 只看該作者
這跟你版子上 Flash的型號有關係
; `, ]; L4 R: S1 A
' C3 ^0 y3 ~5 D一般有個default 檔 : LM_flash_load.bit

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5#
 樓主| 發表於 2007-5-20 20:28:45 | 只看該作者
不好意思,請問可以幫我找那個所謂的default檔ㄇ?我怎麼也找不到  R. b! c% n" P
" b4 I* g" i8 S% V6 r- N
而且要燒到flash,brd檔我也不知道該怎麼寫ㄟ,我只會燒到fpga的,直接指定燒錄檔位置" Q9 v4 e# R  W& X, _" P
6 H$ e' E$ l3 _" `
[General]
& K3 h( f+ w, g3 z5 B* d) L7 h% yName = register AHB XC2V6000 -> fpga8 g. u. H; ]: ]0 f( l/ J
Priority = 1) A" g: e- k9 C! F
5 L0 j% q% W4 h3 Q6 L2 d8 A
[ScanChain]! i. I5 N+ |+ r% r4 k
TAPs = 24 c/ H0 m) E. \4 i& u
TAP0 = XC2V6000
1 Q$ b( W- T+ B' ETAP1 = XC9572XL0 X' Z* u, k2 P( c: p, `

* o/ @" S4 M; k, v[Program]/ {0 b" A: }) y
SequenceLength =1& u; M, ~3 v& A4 b* n1 O( [
Step1Method    = Virtex2
: ?) @* w3 A5 q8 V' y. k& s1 M5 tStep1TAP       = 0+ |9 i' g3 d1 m' V) y  g
Step1File      =register1.bit
, y9 I: F% R5 E( P, X- m$ J* B( U  A( E, `
那請問燒到flash要怎麼加怎麼改?

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6#
發表於 2007-5-20 21:12:55 | 只看該作者

回復 #5 happpyend 的帖子

對於FPGA跟flash燒錄方式解釋.0 K/ [6 v& _/ X& g& b$ U
燒FPGA時,是Bit file,而大家把FPGA想像成RAM,燒完就工作,但電關掉,資料都不見了,所以重開機就要再燒一次,7 {- g% P; V( e" S+ T
要把FPGA拿來量產,那就必須搭配一顆flash或ROM,4 E* R8 E, C$ n
而燒flash時,是mcs檔,原理就是一開機,硬體會去偵測download方式,然後自動download到FPGA,也就是說,每次重開機,' \/ ~$ j! s- P/ b2 k% a$ g
硬體會把flash裡的設計線路,自動download到FPGA去執行,所以設計時只要注意download的模式(ex:spi flash模式,BPI flash模式,串列模式....等).  O6 z, {! V/ v: V: ]2 y
所以一般開發時,都只燒FPGA來驗證function,量產就只燒flash^__^

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7#
發表於 2007-5-20 21:23:02 | 只看該作者
假設 flash 之 memory mapping 在 0x2000005 }: S2 W- q6 [! x1 [
至於LM_flash_load.bit 請你找找 .brd 檔範例 有兩個以上SequenceLength的,用他的Step1 File
! r1 r2 {+ i% m& X# R" @7 j8 @# h9 lltxc2v4000_102c_xc2v6000_via_build1.bit ==> 這個應該是
4 E- z+ j3 F* f7 y4 F! k8 l- t; Y$ N# Z3 P) A) J$ v
[General]( k2 B8 P2 R+ K: I- Z
Name =  Download to flash (Addrress 0x200000)
& Q3 P% H' M$ x2 SPriority = 10 Y% T1 F0 i* L3 m" E

% K  P$ [# F& y) c4 y; O[ScanChain]. V8 {/ e$ }' ?8 ?: t1 {
TAPs = 2
; N4 N: r& Y) r) e$ STAP0 = XC2V6000' B6 L! N+ R# U
TAP1 = XC9572XL: U2 g/ k3 l1 ~. W

3 K7 ]8 V1 _& o' G, L& E  B[Program]: y" o* q! ~+ H% u0 g
SequenceLength =3" G- N# ]$ j/ ^$ T& B
Step1Method    = Virtex2
9 N7 c; \7 [+ U7 P8 W) ^" nStep1TAP       = 0" [" o& f* U  v
Step1File      = ../LM_flash_load.bit
; |$ l8 ~3 K. Y0 a& o- v* kStep2Method    = IntelFlash
  c; k+ D* ?4 |2 P- RStep2TAP       = 0x200000
7 Q$ L) ^% f* G, AStep2File      = register1.bit7 j6 p5 m( I) ^$ r( y
Step3Method    = IntelFlashVerify
8 o1 o* g3 j( v- RStep3TAP       = 0x2000007 ^" [  l( y9 z9 d
Step3File      = register1.bit2 c0 f( q9 S0 {# d- n% z3 R
* u8 I7 @% {) E3 k* Z; b' ?
[ 本帖最後由 masonchung 於 2007-5-20 09:28 PM 編輯 ]

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8#
 樓主| 發表於 2007-5-20 21:39:59 | 只看該作者
ㄜ...不小心選到poor...不好意思...
$ M% {0 J! R3 T# [  ^3 O9 K% [" `; r1 ]# m
你剛剛說的方法我在試試看....
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9#
 樓主| 發表於 2007-5-20 21:48:17 | 只看該作者
我試了還是不行ㄟ...錯誤訊息在附件中
) |5 T4 Q7 X1 K8 `2 K
0 l4 q4 g% ~+ |還是我哪邊還有沒設定之類的ㄇ?

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10#
發表於 2007-5-20 21:57:13 | 只看該作者
應該是 flash 的 Memory mapping 不對8 K9 B: A: x) F
$ ~3 R6 F& [+ @# C. h9 Q3 P
你這種設定是3 X( V2 _/ f% d  e$ |( N
FPGA ==> 0x000000, j* d' e+ ^2 W
Flash  ==> 0x400000! y$ P+ X7 _/ Q  i

# N3 J6 L: S5 ~5 [4 n9 Z3 p$ `5 c( @4 ZCheck 一下你的 Memory mapping 設定檔...
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11#
 樓主| 發表於 2007-5-20 22:10:31 | 只看該作者
SequenceLength = 3) `+ Q0 W; R. X# A3 m% L4 J
Step1Method    = Virtex2
- T3 q4 n/ I+ [Step1TAP       = 0
8 G, j$ }. P6 M+ S. T$ {4 PStep1File      = ltxc2v4000_102cd_xc2v6000_via_build1.bit  (清空flash的檔案?)/ a5 y+ _1 O: p+ ^) W2 W
Step2Method    = INTELFLASH  (??)1 C4 I1 }) C0 L. c  V
Step2TAP       = 0x400000    (這邊是要填誰的位置阿?flash?fpga?)- h9 D- Z) M9 M8 c5 e) a) t/ o
Step2File      = register1.bit   (怎麼跟下面的重複?燒兩次?)8 u. J0 `* K6 b- g
Step3Method    = IntelFlashVerify  (??)2 `# L: R" x: Q8 L( {* m$ T8 C; F
Step3TAP       = 0x400000   (這邊是要填誰的位置阿?flash?fpga?)
6 z* m, L: x5 O0 y! |Step3File      = register1.bit
7 s- O& d* d. H, c7 \+ T+ d  G" B0 t( I& x  z) a
這幾行是什麼意思阿?
3 N! E2 I$ R' a5 W; @% w# B" V+ R9 w) b9 W  H1 N
我的附檔是memory mappingㄇ?

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12#
發表於 2007-5-20 23:05:32 | 只看該作者
[General]8 M7 C0 D  d9 h3 N
Name =  Download to flash (Addrress 0x400000)
1 y7 n% C: I' f& M, HPriority = 1( c3 A% z, c8 P& E& X; p6 Q

2 s$ [8 R5 F7 o  I) Z[ScanChain]4 c  ]5 F8 \  s
TAPs = 2
" J) O/ K  c0 U; g8 f. i& ITAP0 = XC2V6000; u; l6 c# S0 q
TAP1 = XC9572XL
5 r; r* [. W  N2 P
: n3 Y0 A# K! G8 q[Program]
: _! H5 _7 j8 X. [SequenceLength =3
5 r9 K6 i6 T1 U* p! n1 fStep1Method    = Virtex2
5 e( [4 d# ^! N/ v4 Z! e0 V* d+ m& rStep1TAP       = 0              % ?* C. n, o5 X3 r8 G5 X4 i+ l
Step1File      = ../LM_flash_load.bit <==控制Flash開機後載入電路到FPGA (Logic Module)( v1 k# O0 G7 b& h( v" w: O: n
Step2Method    = IntelFlash <== 只是Flash廠牌代號
: P2 V0 b0 |4 ]Step2TAP       = 0x400000  <== Flash位置
1 c/ o' y7 g$ LStep2File      = register1.bit
, U  ?4 r: Y7 n$ y3 a9 f: d5 ~' MStep3Method    = IntelFlashVerify <== 檢查電路有無燒好用
/ I4 Y  V% ~0 _/ X# h2 e/ yStep3TAP       = 0x400000 <== Flash位置% P4 u7 P, e8 ?9 c
Step3File      = register1.bit
3 }- |- m7 w3 ^/ J! d, v! _: B2 q2 g: W! I0 G+ x2 I
看來你要改S2成第二種設定 [1] OFF  [2] ON
0 I/ U3 g5 D6 ?# F- T" B- H& H( H
[ 本帖最後由 masonchung 於 2007-5-20 11:12 PM 編輯 ]
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13#
 樓主| 發表於 2007-5-20 23:17:07 | 只看該作者

回復 #12 masonchung 的帖子

一樣顯示
. m7 L# G  f1 t" [, R6 o- q- Gerror in board description file<step device/TAP>) q/ L/ Q, R0 L1 F
7 B( A' ^5 L7 k( f
.....難道是flash廠牌代號打錯??9 X: q  J! S% U

9 u0 ]% D1 ~6 L/ J0 P  `' I) @: [- h% D還是燒錄flash的時候,有哪些特別要注意要設定或要條jumper的
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14#
發表於 2007-5-20 23:59:28 | 只看該作者
我記得有個Memory Mapping 的設定檔 和你的版子有關係
/ B: q' K+ L  }. t' M但是一時想不起來啥名稱 好像是.arm 還是啥的...
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15#
 樓主| 發表於 2007-5-21 00:21:04 | 只看該作者
請看依下附檔
( Z! f+ H+ j8 I4 r- E* ~) v% Q
: l4 a+ ^' c* }' p) j! T. b: K為什麼我按照LAB的流程- l0 q% @  w0 T( o* Y# y+ ]" D! Z

7 F% v/ L& p+ A$ Q( d他把brd檔分開寫成兩組  }1 \: k# r0 I7 Z8 ^- h5 h
2 Y0 l( [1 ?4 L6 |9 |: m# Y" V
一組寫入FPGA: ?0 h# K. t7 V$ @$ r- e' W' B
' ]. P# `% C5 y% _) a  a7 h/ F) Z
一組寫入FLASH
/ ^7 ], r9 L4 L! L# F3 B8 D; R( b+ f& g+ b
然後先燒入一再燒錄二,而且他也沒有定義address的位子ㄟ
' G8 h0 m9 L$ q0 D. ]6 ]$ P$ m4 h5 k" F6 G7 d. ^
請問這樣真的也可以嗎?布過我想應該可以八,他都已經編成講義了(2003年的很久之前的)

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16#
 樓主| 發表於 2007-5-21 01:24:30 | 只看該作者
請問附檔說的是什麼意思; w; H+ J# _, U! N1 Q4 ~

* h+ [3 P% P( o+ y6 O7 S$ W就是要燒錄到fpga一定要設定成jtag嗎?那cclk又是幹麻的?為什麼為起始設定2 k( D3 c0 A( e& d3 V& x+ I7 U6 f" f

) S  \+ c* u+ j: I用cclk就沒辦法燒錄了嗎?

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17#
 樓主| 發表於 2007-5-21 01:30:25 | 只看該作者
剛剛連結錯檔案...這個才是對的..5 c2 E' [# U3 i9 X/ p

- X7 t! ?3 G6 z( @希望大大可以給我解答
* Z/ p! f; {5 p" C0 \, P0 y5 k+ z, r9 C& f/ v- E8 w
感謝賜教

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18#
發表於 2007-5-22 10:29:10 | 只看該作者
你說講義的日期是2003年...
7 C; q( g# Y$ r1 g! B& @/ n, s- \編著者是誰啊???能說一下嗎?
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19#
 樓主| 發表於 2007-5-22 12:26:10 | 只看該作者

回復 #18 tommywgt 的帖子

http://access.ee.ntu.edu.tw/course/SOC_LAB/index.html6 x* R* [: m: o8 ?

2 O1 C  S$ I! b) Z這邊有連結~~你就可以看的到了
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20#
發表於 2007-5-22 14:18:43 | 只看該作者
......
: w2 X$ Q% k$ {/ j# ]哈...哈...我笑了+ P; A. A: x* b( Q
主啊, 請原諒我
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