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Chip123 科技應用創新平台»論壇 › Chip1 -- 基礎元件 › Layout設計討論區 › 求教 regulator 中ESD rule MOS該如何佈局才可以讓其功 ...
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[問題求助] 求教 regulator 中ESD rule MOS該如何佈局才可以讓其功能達到最大

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1#
發表於 2009-10-20 14:20:24 | 只看該作者 回帖獎勵 |倒序瀏覽 |閱讀模式
5Chipcoin
如題( Q$ h0 h) J% q+ G# n1 V
請教前輩們 在LAYOUT regulator 時 其中有大量ESD MOS的佈局方式 該如何會比較恰當0 E5 E) h. H7 |! l9 z5 t- ~

8 H6 B5 ]; v# H$ q- r3 D. T6 W然後又該注意哪些問題  因為我的w/l  30/0.3  現在再跑 POST- SIM.  發現到每個GATE 端電壓都不相同
7 a/ E) R4 O7 [2 B5 k
$ q) P0 V, d; b  `+ h+ c1 f% G/ T請問有哪位大大知道問題嗎  然後那個MOS 為M 228  感謝

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2#
 樓主| 發表於 2009-10-21 14:10:46 | 只看該作者
就此問題 已有解決的方法了
% E6 ]& h. u6 O9 R發現到 應該不是我的LAYOUT問題: ^) j  V( n3 Y' z" E
應該是我打Label位置的問題 導致 RD在抽RC值 跑POST-SIM.出現  \6 y8 s7 f6 {( U$ [
輸出訊號異常問題  重新標定過LABEL後 以解決此問題了 感謝
4 B, ^) L* |4 I5 C4 Z0 F2 X
( [* y  A+ ^; h; V' y
9 x6 n1 n' S+ s2 R( }& B) J煩請站長將此案幫我做結案  感謝
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3#
發表於 2009-10-26 16:00:36 | 只看該作者
提示: 作者被禁止或刪除 內容自動屏蔽
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4#
發表於 2009-11-20 17:16:29 | 只看該作者
回復 2# clarkhuang " ?4 u5 s/ D% ]& Q& ^# q. H2 J

. S1 A, Y( r* y( U7 T2 s
9 o/ k8 h# a* e$ D( D8 ~; B) _    下次在多注意一下就好
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5#
發表於 2009-11-20 17:18:09 | 只看該作者
LAYOUT要靠經驗的!!!加油6 q# w  \( y) N; G
LAYOUT要靠經驗的!!!加油8 n% z: k3 x: e* ~6 h- |! ?
LAYOUT要靠經驗的!!!加油
4 {- n2 c# z/ f2 h1 W1 fLAYOUT要靠經驗的!!!加油, I$ r& g+ |! b- b3 M3 C( i( O3 P' r
LAYOUT要靠經驗的!!!加油
7 I( ~- Y+ U) d1 r8 eLAYOUT要靠經驗的!!!加油
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