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[問題求助] How verilog HDL to schematic?

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hycmos

電梯直達

1^#

發表於 2009-5-25 17:31:45 | 只看該作者回帖獎勵

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各位高人,在下需要實現這個目標:
我有一段Verilog HDL code,作用是做控制.我希望有軟件能把我的code轉換成實際的邏輯電路,這個邏輯電路不是用CPLD/FPGA這些做成,而是用最基本的NOT/NAND/DFF做成.至於NOT/NAND/DFF用什麽做不重要.
接觸的DC,synplicity在synthesis的時候需要選擇CPLD/FPGA的device,不是我需要的.

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sieg70

2^#

發表於 2009-5-26 10:06:47 | 只看該作者

回復 1# 的帖子

若不是用CPLD/FPGA, 那意思是要下線作ASIC囉?

那可能要跑跑cell-based design flow.

Design Compiler也可以派上用場

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hycmos

3^#

樓主| 發表於 2009-5-26 10:55:51 | 只看該作者

sieg70,

該算是ASCI.其實我做的是數模mix的IC chip,其中analog部分占大部分,少部分是digital的,就是這少部分的digital需要被synthesis成實際的NOT/NAND/DFF/這些cell.
我們現在使用一家fab的lib文件,采用DC來synthesis出digital電路(MOS).
實際上我是希望有independent于fab的lib,這樣synthesis出來的電路只是看到NOT/NAND這些.
BTW,除了DC,其他的tool可以做嗎?

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jerryyao

4^#

發表於 2009-5-26 11:15:23 | 只看該作者

原帖由 hycmos 於 2009-5-26 10:55 AM 發表
- Q. ~$ }! U8 C; P z3 x0 Z3 vsieg70,
5 c. s, ^0 Q: k( `1 f" B
2 |/ Z( _2 N" N該算是ASCI.其實我做的是數模mix的IC chip,其中analog部分占大部分,少部分是digital的,就是這少部分的digital需要被synthesis成實際的NOT/NAND/DFF/這些cell., k4 C3 h9 P" `
我們現在使用一家fab的lib文件,采用DC來syn ...

cadence rtl compiler 及 magma,mentor的工具都是其他選擇。
此外，目前的synopsys還有其他選擇喔。

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masonchung

5^#

發表於 2009-5-26 22:19:52 | 只看該作者

用合成出來的數位電路在mixed-mode的ic來說是太浪費gate-count嘞
我以前作mixed-mode IC 都是自己兜 logic gate

[ 本帖最後由 masonchung 於 2009-5-26 10:24 PM 編輯 ]

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hycmos

6^#

樓主| 發表於 2009-5-27 20:32:17 | 只看該作者

原帖由 masonchung 於 2009-5-26 10:19 PM 發表
! _4 i* @9 t0 t' \用合成出來的數位電路在mixed-mode的ic來說是太浪費gate-count嘞" p) l- |; f; m3 `
我以前作mixed-mode IC 都是自己兜 logic gate

遇到略微有點複雜的logic我自己"兜",還是感覺有些困難.現在有HDL這個強大的tool,能用來做簡單mixed-IC的digital部分也是一把利器.我是希望能用HDL寫好邏輯,之後用synthesis出來實際電路schematic,這種方法是設計不簡單也不複雜的digital的捷徑.目前看來還沒有什麽tool可以有independent于fab 的設計過程.

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masonchung

7^#

發表於 2009-5-27 21:41:59 | 只看該作者

合成的tools也是用驅動能力時間延遲 (cell delay RC wire load) 種種製程特性來最佳化邏輯閘達到Area和Time delay 的平衡點
只要是synthesis 就會用到製程參數輸出的schematic 也必定為製程相關的 logic gates

至於你所說能用HDL寫好邏輯可用HDL Compiler 可以在 Design Vision 圖型界面看到 logic gate 或是 jerryyao 大大所提之那幾種軟體均可

但是這些 HDL Compiler 當初並不是單純要輸出 logic gate 給 schematic tool 用而是要給自家的合成engine做 logic輸入
所以要整合到mixed mode ic 的 MOS level 電路圖還是要寫些程式來鏈結這就要去看那些Compiler出來檔案的內容嘞