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Chip123 科技應用創新平台»論壇 › Chip1 -- 基礎元件 › Layout設計討論區 › 求教 regulator 中ESD rule MOS該如何佈局才可以讓其功 ...
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[問題求助] 求教 regulator 中ESD rule MOS該如何佈局才可以讓其功能達到最大

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1#
發表於 2009-10-20 14:20:24 | 只看該作者 回帖獎勵 |倒序瀏覽 |閱讀模式
5Chipcoin
如題: k6 K. W  p# @4 P
請教前輩們 在LAYOUT regulator 時 其中有大量ESD MOS的佈局方式 該如何會比較恰當
1 c4 p- z3 D" j8 q' X( U2 V2 u) V2 v' {( M
然後又該注意哪些問題  因為我的w/l  30/0.3  現在再跑 POST- SIM.  發現到每個GATE 端電壓都不相同 / g' J8 i$ t; X1 G8 s7 ^# w

- V  m, ^8 P% V% r0 g請問有哪位大大知道問題嗎  然後那個MOS 為M 228  感謝

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2#
 樓主| 發表於 2009-10-21 14:10:46 | 只看該作者
就此問題 已有解決的方法了
: G3 f$ H" p* P0 C" G; k- I: w: [發現到 應該不是我的LAYOUT問題
% q, A9 J' W5 n9 w應該是我打Label位置的問題 導致 RD在抽RC值 跑POST-SIM.出現$ S: g6 I: }5 L6 _2 J! o
輸出訊號異常問題  重新標定過LABEL後 以解決此問題了 感謝1 g+ p$ ^) ?. g" K, |

; r6 M, E' B% y
8 F1 n9 d4 |' }  j/ [9 D1 E' E7 V煩請站長將此案幫我做結案  感謝
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3#
發表於 2009-10-26 16:00:36 | 只看該作者
提示: 作者被禁止或刪除 內容自動屏蔽
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4#
發表於 2009-11-20 17:16:29 | 只看該作者
回復 2# clarkhuang $ ~. U& ~/ z8 M* _' {% M
, i/ a% D& u5 d* y/ o( w

' m, z9 A2 ?0 H, }7 t) V, i    下次在多注意一下就好
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5#
發表於 2009-11-20 17:18:09 | 只看該作者
LAYOUT要靠經驗的!!!加油
9 B, z0 ^/ b& N( V2 PLAYOUT要靠經驗的!!!加油8 x+ P5 i& S9 w) M# x8 W# M& ~, Y
LAYOUT要靠經驗的!!!加油
# a* _) q$ p* ^, w. qLAYOUT要靠經驗的!!!加油* F* {8 L" \- V/ j
LAYOUT要靠經驗的!!!加油
( k. g7 r( R: v* n3 K; }# i. J1 ~6 cLAYOUT要靠經驗的!!!加油
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