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Chip123 科技應用創新平台»論壇 › Chip1 -- 基礎元件 › FPGA/CPLD/ASIC討論區 › 請問xc2v4000+(FPGA)
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[問題求助] 請問xc2v4000+(FPGA)

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1#
發表於 2007-5-20 18:14:33 | 只看該作者 回帖獎勵 |倒序瀏覽 |閱讀模式
請問燒錄到FPGA和FLASH有什麼要注意的分別嗎?都是用同一個bit檔嗎?- O4 }! C3 S: `% Q2 M( P% L
/ m% c+ p3 B5 t
還有就是說如果flash內已經有之前的燒錄檔了,納現再我要在灌一個新的怎麼辦?他會直接覆蓋過去嗎?

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2#
發表於 2007-5-20 18:32:36 | 只看該作者
FPGA直接燒錄的話如果重開機, 就要再燒一次 1 e3 L% c  f. G! w! E4 c. M
如果是燒到flash的話 每次開機就會從flash讀到fpga
9 D) {$ W6 r$ q' k$ ^FPGA就不用重燒啦+ A9 m# T2 _; p! x7 T

# O0 y3 J  I. \8 m9 U/ g燒到flash 和FPGA的電路檔相同 ,但是要燒到flash必須先燒一個flash 載入的控制電路到FPGA9 F$ k; @  E( R- I  n6 ?

) f/ I( @+ ~5 x% c  y8 S* |燒到flash的電路檔 只要位址沒有重複應該不會被蓋掉2 u* i# b- g# j6 x
& z2 \2 g1 ^: b8 \6 p# j
[ 本帖最後由 masonchung 於 2007-5-20 06:36 PM 編輯 ]

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3#
 樓主| 發表於 2007-5-20 19:32:20 | 只看該作者
你說燒到flash必須先燒一個flash的載入的控制電路?9 Q4 c3 I) z/ M' g
那我要去哪邊取得阿?
" I  _! Z* Q: K0 T  c
" M* i4 i# u  G5 X; [  X5 b+ O. |我ㄉ型號是xc2v6000(4000+)
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4#
發表於 2007-5-20 19:56:35 | 只看該作者
這跟你版子上 Flash的型號有關係# o) X/ [/ J2 E2 s0 T) s
, P9 a- F# i5 @5 c$ Z0 h
一般有個default 檔 : LM_flash_load.bit

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5#
 樓主| 發表於 2007-5-20 20:28:45 | 只看該作者
不好意思,請問可以幫我找那個所謂的default檔ㄇ?我怎麼也找不到
9 g% q9 f1 u5 \) X3 O3 u' m
+ B% @, T* a7 h8 g0 R) {而且要燒到flash,brd檔我也不知道該怎麼寫ㄟ,我只會燒到fpga的,直接指定燒錄檔位置- ~' T; V9 H' b! K  M8 q+ s' ^
# N& u4 }2 n6 A% h5 b
[General]( j7 I2 d* W  Y# |& Q# ~6 K# Y
Name = register AHB XC2V6000 -> fpga
% j; a6 j  g- z4 Z1 CPriority = 1
5 l. ^2 k" y7 S2 Y- P/ H! X+ L( ~+ w/ P! `3 `% W/ D5 b5 {
[ScanChain]
  r+ Z' h& k" y3 A, V/ ^2 o3 y: h' jTAPs = 2! c! ~5 k" o% Q2 ]
TAP0 = XC2V6000$ G0 y, q  A9 Y: M" N' L
TAP1 = XC9572XL0 n3 M0 Q; s' {# a+ t6 }

$ o0 b! H4 x+ V# B; L' h, P: Z[Program]9 m2 ]% |' }3 f
SequenceLength =1
( @0 x, L* c. b+ b* D) YStep1Method    = Virtex2: S+ u- R9 k% _
Step1TAP       = 0$ v  b: F' u9 l
Step1File      =register1.bit
: R5 r8 v) {0 h2 Y# d( [
3 P3 L/ ?  A, D- S: k那請問燒到flash要怎麼加怎麼改?

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6#
發表於 2007-5-20 21:12:55 | 只看該作者

回復 #5 happpyend 的帖子

對於FPGA跟flash燒錄方式解釋.
2 Y7 F& b, E" e9 F燒FPGA時,是Bit file,而大家把FPGA想像成RAM,燒完就工作,但電關掉,資料都不見了,所以重開機就要再燒一次,
4 L$ L6 A% S1 n要把FPGA拿來量產,那就必須搭配一顆flash或ROM,: ~7 K/ v6 a- C' F* v+ b5 V
而燒flash時,是mcs檔,原理就是一開機,硬體會去偵測download方式,然後自動download到FPGA,也就是說,每次重開機,! v& L0 u1 W8 s' C: }
硬體會把flash裡的設計線路,自動download到FPGA去執行,所以設計時只要注意download的模式(ex:spi flash模式,BPI flash模式,串列模式....等).( F; Q! _# W* i6 c1 c* X' v
所以一般開發時,都只燒FPGA來驗證function,量產就只燒flash^__^

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7#
發表於 2007-5-20 21:23:02 | 只看該作者
假設 flash 之 memory mapping 在 0x2000009 R7 r" a; q% {8 S1 O+ ]
至於LM_flash_load.bit 請你找找 .brd 檔範例 有兩個以上SequenceLength的,用他的Step1 File
2 [: X: u0 P6 Q3 [/ \ltxc2v4000_102c_xc2v6000_via_build1.bit ==> 這個應該是
) W% N+ g5 Z$ S  o# e
; L6 M( ?) Q; q7 Z" ][General]
  a0 I3 O. A) Y" ]1 ^Name =  Download to flash (Addrress 0x200000): u' v# P4 w+ V" R* W7 T
Priority = 1( k. O% g2 T* J# R0 A: l

- `$ A! G' a( l4 Y' q0 [[ScanChain]1 f( ?5 V3 a: H4 b% p8 J# {! F
TAPs = 2% ~6 }/ u. [  p! m. V8 D
TAP0 = XC2V6000; \$ _7 z, m6 V; v' h
TAP1 = XC9572XL
" h6 @- G/ G2 T, L$ [5 G( e4 x* s3 [. `4 H" d" V3 l6 [
[Program]) _* ~2 F* K% h# j; l
SequenceLength =3
: i6 k& q& A( x# l( O4 ~+ ]# e/ q, @Step1Method    = Virtex2  K: w3 J% c5 p& i9 W
Step1TAP       = 09 T  t7 `/ G+ }4 c( A) D2 z* [
Step1File      = ../LM_flash_load.bit3 f, _& U4 U1 \1 B
Step2Method    = IntelFlash
. r( \. _5 w3 l! L7 `Step2TAP       = 0x200000
8 d7 i$ i4 T; N) C$ mStep2File      = register1.bit6 `* [# J7 ^1 m' i9 F
Step3Method    = IntelFlashVerify# g( o; J" ^- K4 \( o$ Y& e1 |
Step3TAP       = 0x200000
6 h* H& @% _- R: U$ h& k, RStep3File      = register1.bit% k2 t4 |: C1 V0 W* d

* o# V* l  u6 T+ B$ X; _[ 本帖最後由 masonchung 於 2007-5-20 09:28 PM 編輯 ]

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8#
 樓主| 發表於 2007-5-20 21:39:59 | 只看該作者
ㄜ...不小心選到poor...不好意思...; i/ k& e. |* n  {3 y

* F9 r! R6 L8 F" }" {你剛剛說的方法我在試試看....
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9#
 樓主| 發表於 2007-5-20 21:48:17 | 只看該作者
我試了還是不行ㄟ...錯誤訊息在附件中
+ u: ]5 s8 a3 h2 i  A5 v$ `8 W, e9 |7 Z3 h" ~8 P: I6 h
還是我哪邊還有沒設定之類的ㄇ?

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10#
發表於 2007-5-20 21:57:13 | 只看該作者
應該是 flash 的 Memory mapping 不對
/ D* G7 _* C. W2 A4 x( v! m3 i$ }3 w; u9 n# D6 v& M1 }6 }
你這種設定是
; R6 G% @; ^/ ]FPGA ==> 0x000000
  M$ w% w5 [3 [" c8 XFlash  ==> 0x400000. [6 F* i5 v& ~& ~2 w
- n5 E! j# \+ j, ^8 B6 \  O0 G: f
Check 一下你的 Memory mapping 設定檔...
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11#
 樓主| 發表於 2007-5-20 22:10:31 | 只看該作者
SequenceLength = 3
' d7 _+ ?& L- K- H) ]4 }Step1Method    = Virtex2
; P) T0 O! t1 H% n7 x; lStep1TAP       = 0
. w# m' c8 b. n8 j4 CStep1File      = ltxc2v4000_102cd_xc2v6000_via_build1.bit  (清空flash的檔案?)# B2 n6 \1 p) r  P
Step2Method    = INTELFLASH  (??)4 O' k% |$ @# s% _, K/ o8 s
Step2TAP       = 0x400000    (這邊是要填誰的位置阿?flash?fpga?)
. P, d( u0 [& R; w$ l" q9 yStep2File      = register1.bit   (怎麼跟下面的重複?燒兩次?); j, ]! K' U- N8 T" g2 _5 P
Step3Method    = IntelFlashVerify  (??)
# P+ c9 K( N, Q- U% EStep3TAP       = 0x400000   (這邊是要填誰的位置阿?flash?fpga?)
3 U+ n8 @& W6 B5 CStep3File      = register1.bit$ I6 T3 T8 m: B9 i

: p" A& Y' x, y. ?% q這幾行是什麼意思阿?
8 G# `: t( n) Y% O# d6 S9 ~0 \: O2 k& ^# Y# C
我的附檔是memory mappingㄇ?

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12#
發表於 2007-5-20 23:05:32 | 只看該作者
[General]
) u" m- [1 m( F* _' zName =  Download to flash (Addrress 0x400000)- o- ^2 I- b; l/ n2 W" d1 L
Priority = 1% K, B5 }) |, l3 |

- N7 e$ {0 L- v0 N' A[ScanChain]
! j; ]9 |, }* M7 t3 s* f9 pTAPs = 2
2 y* X+ v4 E: z# b4 t6 sTAP0 = XC2V6000
- Z4 t0 B; k0 DTAP1 = XC9572XL
+ X/ g' {) U) L% c0 q6 V6 x
: s& M" }! G% A. d' T[Program]( T8 C$ O' U; d' @) B- ?" w4 X3 w
SequenceLength =3: v, n/ }$ L9 w% d+ M$ h3 H# ~
Step1Method    = Virtex2
# e6 {6 O6 b$ A& n# S& BStep1TAP       = 0              2 H- ~  K; o8 ~  k: \4 d3 M
Step1File      = ../LM_flash_load.bit <==控制Flash開機後載入電路到FPGA (Logic Module)
4 W; a5 c7 R. E0 K& n" U, ]Step2Method    = IntelFlash <== 只是Flash廠牌代號
: o3 W& K, r0 B, I3 sStep2TAP       = 0x400000  <== Flash位置 ( |# `1 `2 l) M0 `& k& S* c
Step2File      = register1.bit
$ x9 }" A) w! s& c$ r1 AStep3Method    = IntelFlashVerify <== 檢查電路有無燒好用7 u/ l% O, l. U) k
Step3TAP       = 0x400000 <== Flash位置9 \: u) f; Y& U- i' y/ P
Step3File      = register1.bit! W+ G& S4 q- u8 k" ]/ \
" [4 w7 G/ s- f1 r# H  T
看來你要改S2成第二種設定 [1] OFF  [2] ON
: j4 t9 X' q9 X. ~/ b9 @( U& [3 z1 F7 r+ E! m; p0 M8 I6 W
[ 本帖最後由 masonchung 於 2007-5-20 11:12 PM 編輯 ]
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13#
 樓主| 發表於 2007-5-20 23:17:07 | 只看該作者

回復 #12 masonchung 的帖子

一樣顯示. T8 J9 T- F, i8 w7 L& _; Z
error in board description file<step device/TAP>
4 [8 e$ s8 _; o/ `$ P: i4 g
1 D4 M" d# t8 d6 u3 E& V7 t.....難道是flash廠牌代號打錯??: q  w# x' X. G; x- g4 i

$ c! C( ^- E% Y2 o# T4 m, ]還是燒錄flash的時候,有哪些特別要注意要設定或要條jumper的
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14#
發表於 2007-5-20 23:59:28 | 只看該作者
我記得有個Memory Mapping 的設定檔 和你的版子有關係9 W7 k0 B7 d- t# f1 i
但是一時想不起來啥名稱 好像是.arm 還是啥的...
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15#
 樓主| 發表於 2007-5-21 00:21:04 | 只看該作者
請看依下附檔" W! r( y; R1 Q5 D) B# S
  @% B+ X* ~1 v" Q$ U2 f4 X7 o
為什麼我按照LAB的流程
7 N0 L& K. t# g4 v' H2 u  P- @: G0 [/ C( ^. |) H& H" L
他把brd檔分開寫成兩組; p, Y8 `' U# d1 M) Z5 m& q

8 h4 a8 X% O. L- f一組寫入FPGA( @- X' B: G- V& S$ v/ i

" d' T. o7 U4 b  h! e# [0 b+ X一組寫入FLASH
. M# n% r8 T  k8 \9 H% }, h
3 O: M6 _+ Y  ^: p4 Q" B然後先燒入一再燒錄二,而且他也沒有定義address的位子ㄟ
  n; c) y8 C& Y6 L) l* [1 n! j# o7 v! t! Q8 _2 s
請問這樣真的也可以嗎?布過我想應該可以八,他都已經編成講義了(2003年的很久之前的)

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16#
 樓主| 發表於 2007-5-21 01:24:30 | 只看該作者
請問附檔說的是什麼意思, {. E& C/ F. I; i
7 `" h6 k/ z! r% `% f
就是要燒錄到fpga一定要設定成jtag嗎?那cclk又是幹麻的?為什麼為起始設定
$ h$ I; ?- B. |+ o# d
+ O7 R4 u+ L# [# d; i2 j, o用cclk就沒辦法燒錄了嗎?

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17#
 樓主| 發表於 2007-5-21 01:30:25 | 只看該作者
剛剛連結錯檔案...這個才是對的..  J# _. K* K2 z3 b' n

( w3 ?! i2 b+ `& ^希望大大可以給我解答( v1 X5 N7 I8 E& m& Q/ Q

. z# K+ t, D  d5 z感謝賜教

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18#
發表於 2007-5-22 10:29:10 | 只看該作者
你說講義的日期是2003年...' E7 N4 _- q4 Z; b/ P% U6 z
編著者是誰啊???能說一下嗎?
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19#
 樓主| 發表於 2007-5-22 12:26:10 | 只看該作者

回復 #18 tommywgt 的帖子

http://access.ee.ntu.edu.tw/course/SOC_LAB/index.html
# \, F  V* F2 [. z- b  h: |! i
- w3 N) i5 O0 O這邊有連結~~你就可以看的到了
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20#
發表於 2007-5-22 14:18:43 | 只看該作者
......
1 A8 k4 \; m2 g: s3 \哈...哈...我笑了4 o5 v4 p, \% @2 B- }
主啊, 請原諒我
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