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原帖由 masonchung 於 2007-5-11 09:06 PM 發表 2 s4 ^2 @6 K0 ?
把軟體和硬體所能做的事混在一起的話,好像就弄不清楚囉∼
) M8 H6 w$ O/ }# T) n) S1. ==> 軟體命令 在 /WR (硬體訊號=0)時當然可以任何時間下鎖住命令(軟體命令) Latch值) v, Z* [$ ~2 T: j
2. ==> 硬體設計解決
& y+ F' b( l7 D+ l( N8 a0 _5 r3. 這個還需配合Latch Enable 的訊號 ... : Q$ b# a% [" x, U Q
4 o; p+ R; s3 J+ }9 t9 x
板主大大您好
8 i" x' U$ k4 g- n' e+ {
) j$ X; B: q9 H. e# k我還是不明白"軟體命令 在 /WR (硬體訊號=0)時當然可以任何時間下鎖住命令(軟體命令) Latch值"% `; ]( J+ p! Y; s8 G
的意思
, z! `) ~/ }4 c: s, b, |: L2 H6 D3 h' t9 f v2 D+ O, Y
假設用51來控制8254,且51的系統CLK與8254的CLK不同步,
( n& I+ ~/ \$ v$ L當51下鎖住命令時8254的CLK還是繼續在跑阿,51根本不知道$ |* S( K) [' z6 }/ R
8254的CLOCK現在是什麼狀況,不會有剛好鎖到不確定值的狀況嗎???; ^: n5 S+ k: j& {3 w) Z
(/WR上緣剛好落在tCL MIN-40~MAX45的區間內)
. g3 c1 w: t) p1 ]# h4 b( {! W( B' W+ U; I
' e7 ^: v6 E. f' M* E" [0 P: {8 R可惜8254的DATASHEET裡面沒有詳細完整的內部構造電路圖3 V: y- c* w) D, Q
9 P. [3 I( p' P+ C我以前有用VHDL來寫8254的功能,可是在LATCH這部分的控制總覺得怪怪的
. U3 ]4 b0 S8 s; d- Q! Q/ l2 }上GOOGLE搜尋也找不到相關的詳細參考電路或設計 |
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