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Chip123 科技應用創新平台»論壇 › Chip1 -- 基礎元件 › Layout設計討論區 › 求教 regulator 中ESD rule MOS該如何佈局才可以讓其功 ...
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[問題求助] 求教 regulator 中ESD rule MOS該如何佈局才可以讓其功能達到最大

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1#
發表於 2009-10-20 14:20:24 | 只看該作者 回帖獎勵 |倒序瀏覽 |閱讀模式
5Chipcoin
如題: U4 _3 G; J7 `; v4 q5 E1 ]! a, e
請教前輩們 在LAYOUT regulator 時 其中有大量ESD MOS的佈局方式 該如何會比較恰當
) J, Q: h2 z+ u; _6 f; H) g. P- @% D- T7 p
然後又該注意哪些問題  因為我的w/l  30/0.3  現在再跑 POST- SIM.  發現到每個GATE 端電壓都不相同
2 H; p/ e3 J; l2 Z. N0 A+ ?
! t7 N$ v2 r% z4 l" A請問有哪位大大知道問題嗎  然後那個MOS 為M 228  感謝

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2#
 樓主| 發表於 2009-10-21 14:10:46 | 只看該作者
就此問題 已有解決的方法了% n% u) P& s$ `- y. B
發現到 應該不是我的LAYOUT問題1 E5 @- ?6 I' ]/ u* |
應該是我打Label位置的問題 導致 RD在抽RC值 跑POST-SIM.出現0 l7 c* m. M9 L7 M9 O
輸出訊號異常問題  重新標定過LABEL後 以解決此問題了 感謝
. b/ [7 E* m6 J' g1 t- V' A8 ~+ n2 {3 V0 J4 x' s
/ u! r9 h! X8 J% w' e; w! ^- z. `* P
煩請站長將此案幫我做結案  感謝
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3#
發表於 2009-10-26 16:00:36 | 只看該作者
提示: 作者被禁止或刪除 內容自動屏蔽
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4#
發表於 2009-11-20 17:16:29 | 只看該作者
回復 2# clarkhuang $ z" D( l0 I6 W) v, R: e2 L8 {

9 x+ A. M/ V0 z! Z
% i3 L: I2 V5 _& n* |# T" E7 M    下次在多注意一下就好
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5#
發表於 2009-11-20 17:18:09 | 只看該作者
LAYOUT要靠經驗的!!!加油
0 V! M2 l. ~- u: F' y: TLAYOUT要靠經驗的!!!加油" x6 X. [( U8 e# _
LAYOUT要靠經驗的!!!加油
0 X1 {3 S2 O+ O8 U" bLAYOUT要靠經驗的!!!加油; }1 @0 d7 x) l' p3 B
LAYOUT要靠經驗的!!!加油
+ a) F5 U- j9 x1 F# a5 O6 m5 uLAYOUT要靠經驗的!!!加油
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