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因為 SystemC 可以囊括 high level abstraction 從 behavior -> transaction -> RTL, 所以學習 SystemC 可以從目的來分類:
8 [9 d. O+ q& ?1 z& w
3 m* g0 C, @6 o, F8 e如果你想做的是 RTL/testbench writig.9 U8 D- p( M: ^# N8 ]9 \
底下這一本提供一組 SystemC 在語法上的 subset, 可以說是把 SystemC 當做 Verilog 來用: d9 k8 I, e L2 a
"A SystemC Primer," by J. Bhasker( A7 v& u% D/ ~
7 Y! x7 V! ~, D如果你想做的是 modeling/TLM.
4 [# Y0 |9 |7 m: ]/ L4 U這邊難的地方在於會用到大量 C++ 的 class, template, 以及 object oriented 的觀念, 強烈建議要對 C++ 的 OOP 有點觀念:
+ r, Z7 k0 x- K" ^8 F1 X: i8 b"SystemC: From The Ground Up," by David C. Black and Jack Donovan
/ g5 k" z" f' [' T. h( {"System Design with SystemC," by Thorsten Grotker, Stan Liao, Grant Martin, Stuart Swan0 ^# E0 @) o# V4 z7 t. V
0 S, R/ d5 u( \* Z! q% ~+ a一般 research.
& _5 C' Z6 R" b+ T5 Z. v包含較多觀念, platform, simulator kernel, simulation speed, verification 的探討:2 z* s' {# q3 z
"Systemc: Methodologies and Applications," by Wolfgang Muller, Wolfgang Rosenstiel, Jurgen Ruf
. n1 U) U5 |0 I& [5 z% Y [2 \"Transaction-Level Modeling with SystemC: TLM Concepts and Applications for Embedded Systems," by Frank Ghenassia. H# i9 }0 K' U' y. q5 {0 q
0 w5 P8 a: V( f2 B- ?8 lSystemC 相關的 spec.* D% \% H2 \6 v" H! I
如果要 implement hierarchical channel, 光靠 "SystemC: From The Ground Up" 我想可能不夠, IEEE 1666 SystemC LRM 可能可以協助更了解每個所用到的 class, 以及各個 class 間的 relationship. TLM-2.0 目前有 OCP-IP 和 Greenbus 已經採用 (commercial tool 的 bus model 可能也有用). SCV 我個人尚未成功 compile, 可能麻煩其它先進補充 :
) p( o8 d" Q0 r) sIEEE 1666-2005 Standard SystemC Language Reference Manual (LRM)
) Q7 J; ?! T2 @2 n8 WOSCI TLM-2.0 USER MANUAL# a% v$ k: L4 X" J5 s' H, D# i
SystemC Verification Library (SCV)
! \( Q* J" Q) t4 U& c6 d. }' w上面三個都可以由這個網址下載: http://www.systemc.org/downloads/standards/ |
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