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Chip123 科技應用創新平台»論壇 › Chip1 -- 基礎元件 › Analog/RFIC討論區 › 求助PLL問題之PFD Block
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[問題求助] 求助PLL問題之PFD Block

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1#
發表於 2010-11-30 10:59:55 | 顯示全部樓層 回帖獎勵 |倒序瀏覽 |閱讀模式
各位大大好，我是剛接觸PLL的新手。: R9 X+ }3 u9 j8 z; Z
有以下問題(本身是用.35製程)    抱歉，如問題很"新"請見諒...2 K. D* K& _3 r. b: x4 O
1.PFD所產生的dead-zone是要在多少( ps ) ??  之下是算合理的範圍，才能讓cp正確的判讀，達到充放電??
" @8 f' z  V  N, D3 D2.PFD只要解決dead-zone ，PLL不管是何種型式，都能給於CP正常的充放電是嗎???2 M0 o6 S: I) d4 t; P+ v
3.還是以上兩個問題，都不是PFD的重點，還是有需要考慮其他的因素???) H; @, B4 s: d2 o: t) s
先感謝各位的見解囉6 {3 B/ i- _. G3 M1 L
順便貼我的電路圖
& H' `$ C) n3 S) `

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2#
 樓主| 發表於 2010-12-14 20:47:27 | 顯示全部樓層
回復 2# 雷迪斯
0 R3 t7 ^' b) `) T! o3 y- [0 P. j3 X5 [& ]
3 }& F4 S/ Z7 Y: ?6 U' e% j" X2 u
    嗯嗯 ,還是感謝你的回答囉
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