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Chip123 科技應用創新平台»論壇 › Chip1 -- 基礎元件 › Analog/RFIC討論區 › [問題]關於某篇文章設計capless LDO 的 PMOS
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[問題求助] [問題]關於某篇文章設計capless LDO 的 PMOS

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laasong
1#
發表於 2014-9-20 13:14:42 | 顯示全部樓層
來看一看+ f  }6 P) Y  H1 I* s8 _
capless ldo真的需要考慮更多的是  補償  voltage drop% A! Z7 E1 l7 }; \: D4 d6 i2 }- C2 @
傳統作法都是還會在layout有空間的地方塞一堆電容1 G, S4 T" i( i& U
比較新的作法本身是還沒試過  畢竟  公司要的是做出來的時間而不是讓你慢慢研究阿QQ
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