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樓主: michael6172
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[問題求助] 用verilog撰寫取對數log電路

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1#
發表於 2010-12-15 23:48:26 | 顯示全部樓層
先回覆,改天在來看code
9 _  P5 u1 B4 x9 I0 B" c9 s( p' V, |( _9 N( `7 {
我也有在做對數轉換器
9 j7 t- e/ [8 d! X' @我是將數字表示成 N = 2^k(1+x)1 B* h3 z) d5 q8 _4 D2 W0 x6 K
以Mitchell的方法為基礎進行改良
/ A/ \/ f+ L- Z* E+ `0 t' [
0 I' U, A* m0 u  n- K$ V% Q5 J9 L好久沒上來了XD
' }. M, o/ J$ D, c: S( e上一次來是在問FPGA方面的東西" E! V' t, A  b6 ~, w+ P' N
因為要在上面實做對數轉換器
' k, s4 m' ^7 R' R+ h2 _不過那時沒得到協助
$ C: x8 ~; g4 e# J/ H( Z8 X幸好最後有成功做出來
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