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[問題求助] 請問一下關於Xilinx logic gate的關係

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1#
發表於 2007-8-14 09:26:06 | 顯示全部樓層 回帖獎勵 |倒序瀏覽 |閱讀模式
想請問一下各位使用FPGA的先進8 w% ?( m% ~5 I6 i9 {3 ^' ^# c
Xilinx產品系列的容量大小是要以那個為依據才是一般要購買自己所需Design的FPGA$ y6 L$ S: G4 ~8 ?2 @2 H9 W
是System logic gate, CLB, Slices, Flip-Flop... etc..
- ~( n# [9 j' g( y3 h# l. n6 f不知道這些是否有關係式?
  f0 M0 E$ T0 d# O' W' U據小弟所知在Virtex2及Virtex4 1CLB=4Slices,而Virtex5好像是1CLB=1Slices,
6 x" R9 L! O) w4 {/ @- W" |請各位先進給與小弟指導一下,謝謝~~
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2#
 樓主| 發表於 2007-8-19 22:48:26 | 顯示全部樓層
感謝tommywgt版大的解釋! V6 L! D. |1 z; L% ~0 U
原來Virtex5是1 CLB = 2 Slices
. M1 u6 f# ]5 z難怪我怎麼算都不對
+ f1 b7 H, \! Q5 Y$ V! S$ b4 o終於懂一些些了,謝謝~~) s# Q1 c5 x" o3 a4 \
- c) Y* f7 W4 j% B7 A
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