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就以我們自己的作法,在chip內部是把digital和analog的power完全分開,亦即是兩個完全獨立的power supply
如此一來digital和analog兩者就power supply就不會有互相干擾的問題
當然,若沒有那麼多power supply pin的話,通常則是採用將analog block作一個內部的LDO circuit
如此一來,analog block則因為透過LDO所以對於power supply則比較不受干擾
不過,先決條件則是LDO的performance要夠好,PSRR儘量要在72dB以上才行
至於在signal跑線上
我們較注意的是digital clock的跑線在跨過analog block的區域為何
因為digital clock signal的頻率都有幾百MHz,所以我們都儘可能避開它穿越一些analog block,若真無法避免,通常作法是隔>=3層metal
而對於一些極低頻如32.768KHz以及differential signal(如two port ADC/DAC output signal), 我們在內部會用shield方式來作
最後,power mos的on/off的noise是很難根絕的
我建議的方法有二
一是採用不同的power來供給,當然,這要看能否有多出來額外的pin和power supply
另外一種則是採用內部的LDO來隔絕power noise的干擾,不過這個樣子會多出一些額外circuit
而我們採用的是第二種方法 |
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狗仔卡
發表於 2007-6-2 10:28:58
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