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SCR of ESD Protection in Submicron CMOS Technology

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1#
發表於 2008-10-31 13:12:02 | 只看該作者 回帖獎勵 |倒序瀏覽 |閱讀模式
Lateral SCR Devices with Low-Voltage) [& T. |: |2 g! x8 Y+ c# F+ ?
High-Current Triggering Characteristics for Output( [- l5 h% T$ b, N7 m
ESD Protection in Submicron CMOS Technology6 X& ~* \( ?! L: v$ k. h8 s
0 @! y! u" R: {
IEEE TRANSACTIONS ON ELECTRON DEVICES, VOL. 45, NO. 4, APRIL 1998
; U" E% o% K' M6 I4 Z
; b3 a: }! h9 w' x0 z" i
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2#
 樓主| 發表於 2008-10-31 13:14:33 | 只看該作者
有实际的流片过且测试过SCR 的ESD效果的吗?据说(非本人经历)0。35一下工艺可以达到6KV(HBM)!
3#
 樓主| 發表於 2008-10-31 13:19:16 | 只看該作者
SCR确实很省面积,但是由于出发机理类似Latch-Up,所以实际应用时要注意防止触发"Latch-Up",这是一大难点!
4#
 樓主| 發表於 2008-10-31 13:29:08 | 只看該作者
我不是很了解,好像大型的Foundry厂(TSMC、UMC、SMIC、UMIC等),都没提供采用SCR保护的I/O!可能SCR技术不成熟,或者有风险!大家的意见如何呢?盼望一起讨论一下
5#
發表於 2008-12-4 21:24:20 | 只看該作者
看看                                                               $ q' R& @7 w6 V/ V( }+ v2 V
多谢
6#
發表於 2009-1-21 17:14:39 | 只看該作者
我的片子剛剛回來,測試了好多次,有一次芯片坏了,不只是ESD還是LATCH-UP,很是鬱悶啊!  
9 v! ^9 U; z0 j8 o1 X5 J) v& V2 ~0 ^' f: D" @1 T5 U
多謝您分享這篇文章!
7#
發表於 2009-8-28 20:21:04 | 只看該作者
thanks for your data ..............
8#
發表於 2009-9-18 14:35:00 | 只看該作者
不錯的參考資料, 謝謝分享!
+ B9 X3 L- K: f+ S7 e: L剛好需要, 謝謝分享!
9#
發表於 2009-10-16 10:19:50 | 只看該作者
This is what I need document....
1 P- P% t! H( p7 b- Y+ B2 G  n2 i- w4 v  Y2 a- \* y; h/ k# D
  K8 @/ X* U9 \1 ~
Thanks.
10#
發表於 2010-2-26 14:42:06 | 只看該作者
不錯的參考資料, 謝謝分享!  
( ?( P6 d- f: @9 l) _( u7 L( Y1 K+ v6 ]1 R
謝謝
11#
發表於 2010-12-21 20:49:26 | 只看該作者
謝謝分享
. m" O# a5 F$ `. `8 s6 u7 N2 L: l; g% b( }# I
剛好有需要+ c/ K. o: ]  b, b5 P- Y$ K
下載來看看
12#
發表於 2021-8-26 13:35:25 | 只看該作者
受益'良多$ {+ T$ S# N: v4 v5 D+ \4 A

+ O: l) V5 P  W. T. u6 b7 ?謝謝大大的分享!!!!
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