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[問題求助] 如何建立一個standard cell library

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發表於 2008-6-2 20:10:25 | 顯示全部樓層 |閱讀模式
請問要如何建立一個standard cell library8 t% Y; C* _8 \
也就是設計一個給Design compiler使用的.lib6 @. b  r* b$ Z. f! g
其中timing table   power table 內的數值是如何得到的1 f7 |  e2 i; F& ~
能否給小弟講的清楚點7 e& e$ ]4 B& A7 ^/ V
謝謝
發表於 2008-6-5 22:48:33 | 顯示全部樓層
我朋友做過 主要是跑SPICE模擬
發表於 2008-9-16 15:26:16 | 顯示全部樓層
Hi,7 D+ Q: r/ U6 p& f% O' s) f
以前待過有in-house cell-libaray的design house,一般還是用spice去將每一個cell的timing arc給sim出來,在將meas的結果利用像perl的程式轉貼近一個新的檔案,而這個新的檔案格式是跟DC用的格式一樣,就可以了,其中,timing arc的求法有很多種,較精確的像curve fiting...etc.當然,power也是一樣,而digital大部分只用三個cases就好了,我想,厲害的地方應該是spice的stimulus,因為需要用逼近的方式來求解,應該會用到"optimization"的技巧.4 G0 T" L& n: e6 V, y' h  g0 t
希望能有所幫助,3Q~

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masonchung + 5 回答詳細!

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發表於 2011-3-10 08:59:37 | 顯示全部樓層
感謝大大分享, 讓我們有技術交流的機會
發表於 2011-10-4 17:45:30 | 顯示全部樓層
現在已經有EDA support. 可以查查C or S.
發表於 2011-10-13 09:57:57 | 顯示全部樓層
來聽聽看大家的經驗談  希望對工作有所幫助  " k/ E" h. C  V0 p
謝謝
發表於 2012-4-7 17:17:27 | 顯示全部樓層
thanks1 w/ I9 G  k$ v  E9 O
感謝大大分享 希望對工作有所幫助
發表於 2020-6-24 22:08:40 | 顯示全部樓層
EDA support :: l: v: z) s. x& W* h4 {

* R! W$ X% t4 W2 cC --> liberate
7 Y  M$ i9 K- p1 Y: h4 Q3 yS --> silicon smart
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