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Chip123 科技應用創新平台»論壇 › Chip1 -- 基礎元件 › FPGA/CPLD/ASIC討論區 › 用Verilog撰寫(浮點運算)開根號的電路
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[問題求助] 用Verilog撰寫(浮點運算)開根號的電路

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1#
發表於 2012-12-12 21:23:35 | 只看該作者 回帖獎勵 |倒序瀏覽 |閱讀模式
本帖最後由 key456456 於 2012-12-12 09:31 PM 編輯 : ^8 {( X- f' {
( |& H  H+ J# T! G' w0 s
請問大大們有沒有sqrt的code8 D/ y5 E, Q. e
0 X& j* }9 e) g0 r; V
想看看研究一下& o) P$ S6 v3 m8 k! b' R6 R) b) e
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自己實力不夠寫不出來
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