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[問題求助] 2010 CIC比賽之後 想知道正確的電容畫法

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發表於 2010-4-2 01:42:16 | 顯示全部樓層 |閱讀模式
3月24號的CIC比賽佈局圖沒做出來 原因就是電容不會畫=.=3 _2 H5 b2 `# {  U" B
然後趕快去翻書番講義 好不容易搞出一個電容 跑LVS有跑出誤差蠻大電容值 重點是電容短路了 結果辛苦八小時泡湯了   d+ J& b6 c' b; M6 O' C
所以想請教各位先進 正確的電容該如何畫 ) p5 t/ }) [+ H0 w; c
話說去年我還特別去CIC上課 老師還說:唉呀電容用叫的就好啦 幹嘛怎麼辛苦的畫......  今年卻考電容
/ L  s7 m+ L) d/ N, {% \/ i6 g4 N% A; a/ L
我附上我最後的布局圖 請各位多指教 # I1 g+ w8 a" i* A# C1 r

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發表於 2010-4-4 10:20:11 | 顯示全部樓層
當然可以當電容呀...
3 \  m$ p# [) H; Y. o# T( m在cadence上你也是要畫mos 等效的電容而不是叫出一顆平行板電容
2 }) Q9 x. l* [, _( H9 @' i& u否則lvs決對過不了!!(電腦是很笨的)2 N; x  @% Q  Z2 ]
不過基本上都是在數位積體電路上來"等效"一顆電容(類比也是可以啦)! y/ S+ q2 j. E
因為一顆電容就可以遠大於你所有邏輯電路的面積4 C1 q! [  ~) x1 J/ i" s
不過我沒看到電路: y0 E. s- V9 [
所以沒辦法做結論判斷(是類比電路還是數位電路?^^a)6 d# c+ {+ F# ?/ A1 D. t

' h# c, M4 G1 ~. |) }, v' q& F) A若你用平行板的電容外圍要加保護環!!
+ |7 X; I) c" S4 ?# B& O/ \
6 Y+ A4 a6 ]6 Q1 i$ W! L* N我看了一下圖示那應該就是說用金屬層(M)兩層9 I" W$ M( v3 \+ D' h- m
金屬層四邊要去角避免電荷積聚& l2 N% D4 {6 i9 G
然後想像一下電容的樣子
9 D' A4 [* u& O8 |) O  P  A6 f- [一定會有接點接出去
  H/ a+ E  o* O5 Z所以或用via 或contact接出去
) ^/ ]3 Q% X: B4 i7 s; c( i- h; S  Z但最大問題一定是w/l 要去算一下4 X8 w# e' ?2 f4 \0 m
! Z; x  l$ b: T( |
你可以先試著畫電容然後lvs去跑值lvs會顯示你layout時的c值$ G  Y( e0 G! m1 c2 `
通常會有一些些些誤差!(很難完全準)7 f0 p& X: b9 Y; \

# J* g* g: @, f: {" K& z$ i% Q0 a+ y打的好累= =zzz) h7 f& t& G. q7 q3 D
多去網路上看看吧~5 V- y3 c: S3 T5 I4 c1 @1 G4 }& k, R' q
製程文件也一定有教
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發表於 2010-4-2 10:34:59 | 顯示全部樓層
電容有幾種 簡單來說 2P , 2M ,  2M+MIM , MOS 電容  其他
' `" j  x* _& e- ]2 i; {# U" Z1 r7 M7 Z; \, b4 @0 T# t7 P
爬一下文 應該有相關資料
- g, H$ S6 k( w1 p5 f6 j
# p  x: c" |8 F! a3 n: l4 g% G/ Y面積 X 參數值 = 電容值  (參數值 通常design rule 有)
 樓主| 發表於 2010-4-2 18:15:52 | 顯示全部樓層
我看CIC給的講義是講2M+CTM3 J) }8 ?0 \9 }( F- b- Q
所以我就照講義上畫 DRC還說M5要離CTM 0.6u 所以畫成這樣
& U4 Z: r' O' ]" |- W! K可是LVS卻說這電容短路..所以我不知道我少哪些東西2 K$ J& ~, ?9 X& F1 {+ ~
這是RULE給的電容值算法
: X2 {- P. V! D$ {Ca = 1e-3         // F/M^2* t3 Y/ S4 H. T* H0 h- y# X
Cf = 7.5e-11      // F/M) c2 D2 ?$ D7 ?- k4 U
C = Ca * area(CMMC) + Cf * perimeter_inside(CMMC, SEC_LAST_MET_C) ) b) f0 x& V, B9 V+ n8 j: M
! W1 Q; Z& v& ~& ?+ m7 C
論壇大部分有用的文章都有設定閱讀權限 我想看也看不到 所以直接發問比較快..
發表於 2010-4-3 10:42:31 | 顯示全部樓層
請問你是大學部f組(可程式規劃@@?忘了)的吧!
2 }, h& f0 k, c# V& Y  u* Z0 m2 l* E( R' i) Y0 _3 `+ g6 }
我大概有看過題目但我不是參賽者!
( o3 [4 e) X6 G# y
8 O; W5 H: s* Y6 H2 E電容不一定要用類比式的電容(也就是大大方方一顆的兩層金屬板)
1 }7 u9 [! j( \  Q1 C
% @5 |$ b+ _) [9 ?  H% Q數位積體電路可以用mos來等效一顆電容
( r+ m2 l7 g& D* p  q# \; a5 r1 k' V8 E) u( Z: }
也就是將s和d極短路而g極連接出去
( b$ o" G  c5 M' t: S2 }. [( K+ ?* e
" \$ V  j* v( _, s0 w. `  b這樣一來就可利用中間的氧化層和mos的w/l 組成一個電容
8 B& w. R; h2 O+ s; M$ V, I) ?' W( o# j! v/ }) q2 C$ c
w/l就是決定您氧化層那一段的面積也就是大約等效出您的電容值
3 V" {6 C( N( z: e6 v( e7 ]8 R4 \9 Q- M) R" T- A. e
不過您還是要實際去跑一下模擬!必竟不同材值會造成不同的結果!!: l6 o+ Z6 O7 u
  D" b/ k4 A7 a- Q% M' X0 b. c
當然~mos也可以等效成電組^^
 樓主| 發表於 2010-4-3 15:41:45 | 顯示全部樓層
我是大學類全客戶設計組( O+ e6 X' [- e; @- p0 g
看到樓上的回答 馬上遠端到學校LAY ' X. G8 [  _( D/ G+ n
畫好發現我Netlist要怎麼指那個MOS是電容
. k& K8 M" \& {  M/ d然後看一下LVS的RULE只有一行定義電容名字1 f/ G, w. `, d$ Z" U
c. MIM Capacitor :& o0 Y$ O$ p+ e0 y
  . Metal5 Mixed Mode MMC Capacitor (MIMCAPS_MM)
" g/ d8 s+ [- s; X$ C就沒了
" D6 T1 _' W: M9 p6 z# n0 h所以好像沒辦法把MOS當電容/ {3 |5 Y3 x% @# o
順便附上我看講義上的電容畫法是否正確
% ~, Q, p/ V& \$ G  |

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 樓主| 發表於 2010-4-6 01:04:27 | 顯示全部樓層
本帖最後由 lunarsama 於 2010-4-6 01:08 AM 編輯 5 Y# e# A! u  X7 [9 C% `
& y3 A" s: b. _$ ]+ l+ o1 x
清明連假的結束之時 終於把2010試題給完成了 總算對老師有交代了 2 W7 G  s7 \% ?( o
星期天凌晨兩點LAY到一半 學校伺服器當掉畫面卡死 感覺叫我趕快睡覺 $ \: v8 |4 o" q* Y
星期一下午伺服器重啟之後 第一次把電容無錯LAY好 只是電容值誤差蠻大的
$ y* w' s; v8 C$ {- |$ z7 m5 X索性做一個試算表好了 也比較好找電容值   F3 h- _0 e5 C. i
做好電容之後發現該怎麼接到電路裡 就直接挖個洞拉出來接了 也不知道是不是正確的接法 - q' v  s5 d% t5 P5 A
反正DRC/LVS過就好啦
) a5 P6 I; ~3 ?  @, o5 h6 N. f樓上大大有教用MOS當電容 雖然讓我豁然開朗 我還是不知道怎麼用
7 W1 Z; M1 e% P" rcadence該用甚麼零件當MOS電容 像laker裡MIM叫[MIMCAPS]來指定她是電容
4 G  S# a  Q3 F# ~3 K# {8 QMOS電容就不知道叫甚麼了  可以在詳細講解一下 讓我有個方向
+ E. l) b6 ]' s! @" y5 F+ Z
( r- |9 L* K* e" e不會畫CIC的MIM電容可以參考看看吧 電容大小:8.1ff電容 沒辦法整數
3 y" g; d6 o' A4 b
9 y) ]0 E. m9 g7 g最後佈局圖 只是覺得電容接出來感覺怪怪的 可以有人告訴我是否正確
+ L; E% M7 c( }. a+ N( ?
+ U2 b! [( Z! S5 ^7 X& B% @. d順便把CIC電容表貼出來吧 看有沒有要吧
1 W: m$ P9 Y  ?9 I3 `5 Z

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發表於 2010-4-6 13:37:50 | 顯示全部樓層
一起多研究吧^___^
  a* M9 s, v. T+ n+ t5 n6 v$ l* Z% k, ]
不過看你得電路畫法
  ~1 B6 Q$ V' ^) f& q( V
- V% H% @8 V5 [" ~% C5 Q感覺像是數位電路
) u& I% D- r7 p! y' |
/ U& ^, s( L) E, m! a# `; Op在上n在下
# ]7 {2 {2 q, s; ^( S$ w' e4 s; i% e- f
呵!
發表於 2010-4-7 17:36:20 | 顯示全部樓層
都说是电容啦。。那也得看上去像电容啊
  p0 z1 ]1 [5 `% d9 D9 A& A画两个大的MOS管就好啦 fingers=2* X7 f- m! k: G- |
比你那样好看多了
" N% ?3 c* y& P5 }% X$ G' ^; `
8 G5 D6 a" ~, {, J/ ~5 V
 樓主| 發表於 2010-4-8 00:45:05 | 顯示全部樓層
我有去問碩士的學長
+ d; W1 B6 D3 a) o他說今年CIC的design rule 只有MIM的電容規則裡
! q- T4 b" Q& Q5 c9 X8 i* q& ~其他種類電容都沒在design rule裡面
, c* w5 |% i/ F/ X# B, k0 d所以其他方法都無法通過驗證
發表於 2010-4-8 17:42:09 | 顯示全部樓層
嗯...Metal-Insulator-Metal喔
; Q  z! t5 ?" ~, \, Z那就很有可能!!!
  p* _3 E( V0 Z2 R
8 B, Q3 d) v% A  e8 E& E- }* B& D1 @你說的design rule 過不了$ v* X6 O$ n3 I3 Y  r# l$ d  B
我想你是說在cadence 中是用MIM電容' m9 r0 d8 i5 v3 i2 b% X
但佈局卻是用MOS等效電容# v4 S. z2 A" P2 h
# S, s) u; R( q, `
這樣是一定沒辦法過的!!1 _; U2 `( L, {6 A
7 k% Z  e1 J7 [5 i! `4 p4 T$ Q
但是...如果在cadence中就用mos等效電容
" ?7 a7 o' }3 W# f; d那這樣還是可以過的!!
發表於 2010-5-10 23:25:15 | 顯示全部樓層
類比元件的電容好像很難畫....
- i$ y- H* p% F# C那個老師說用叫的...是要怎麼叫阿...
' w  }2 v7 a& ~5 d# J該不會是叫一個NMOS或PMOS
0 E) y: R) W$ d( j% S8 }然後再把S端D端相接% S8 l( S( r2 {; |; [) K
在去算他的L、W、Cox?
發表於 2010-5-19 22:38:30 | 顯示全部樓層
回復 3# lunarsama # }/ f5 J% n- p- D3 Z
* z: e1 j4 H& n; \  d, Q9 C5 g. I' T

8 ]  i4 y+ Y* v) k( r2 y/ Y    請問您這次比賽所使用的process是...
) a/ }  B6 H2 J* h. S如果可能的話可以寄LVS command file給我
. k  P5 D: L, Q' N2 k% V2 }" C我幫您看看是哪邊出問題
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