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[問題求助] 關於undersampling ADC的問題

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發表於 2007-11-8 14:07:20 | 顯示全部樓層 |閱讀模式
設計的undersampling ADC用54MHz sample rate採樣44MHz signal,出現17MHz的雑訊,請問各位先進可否指點?
* O- o& ^3 v0 v- A6 t3 Y或者能否提供相關資料?因爲之前曾經看到過類似的解釋現在急需卻找不到了。:(

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 樓主| 發表於 2007-11-8 17:58:02 | 顯示全部樓層
原帖由 jeffsky 於 2007-11-8 02:07 PM 發表
3 {# V$ d4 K; K; r設計的undersampling ADC用54MHz sample rate採樣44MHz signal,出現17MHz的雑訊,請問各位先進可否指點?
$ ~$ K- O9 @; x8 I# o: Y' U或者能否提供相關資料?因爲之前曾經看到過類似的解釋現在急需卻找不到了。:(
( M  n/ a7 n9 y
????????????????????????????????????????/4 M8 T* j$ c/ g; H$ p

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發表於 2007-11-9 23:51:42 | 顯示全部樓層
17MHz 的 tone 會不會是系統OSC or XTAL 的 16.667MHz clock feedthrough noise?
4 k  m) Z; R+ p7 ?: L
" F: m% R2 r5 j9 o! A因為即使是under sampling, alias image in first order term: (FS=54MHz, Ft=44MHz, Nyquist band=27MHz)) ?& |. r4 ]: c# ]5 U; k
FS-Ft=54-44=10MHz
6 A* W: a( o, F, @FS+Ft=54+44=98MHz (folding 回 Nyquist band=10MHz)
  o. L: p) P* \/ W
. D( \' f4 ]9 v4 B2nd order term:2 w! p9 {5 ]7 m; Q* f( K. G7 u
2FS-Ft=108-44=64MHz (folding 回 Nyquist band=10MHz)0 A2 c; p3 D5 k8 M; k1 r
2FS+Ft=108+44=152MHz (folding 回 Nyquist band=10MHz)
, L. f6 D& s8 u0 y; [' `|FS-2Ft|=54-88=34MHz (folding 回 Nyquist band=20MHz)
4 ~2 b- ~& q1 q' b8 E( D7 G# o- gFS+2Ft=54+88=142MHz (folding 回 Nyquist band=20MHz)1 E! ^4 P0 B* n8 W
. c. P& u6 v3 \, \( [
2nd~7th Harmonic:
/ B# P: o# l" U+ \5 S! F2nd = 20MHz
/ R' ^! Y5 r# \, O+ J8 P. {: K3rd = 30MHz  (folding 回 Nyquist band=24MHz)
6 E7 ^$ l& c+ P0 F4th = 40MHz  (folding 回 Nyquist band=14MHz)
% N+ u# ]) q7 o5th = 50MHz  (folding 回 Nyquist band=4MHz)
( N4 _* G% _$ f6th = 60MHz  (folding 回 Nyquist band=6MHz)2 l. s  H& g! @" N3 a1 D" H# d* p
7th = 70MHz  (folding 回 Nyquist band=16MHz)% A6 @" k5 e/ Z0 [  ?! M. I
你附的Frequency domain plot 在6th之後已在noise floor之下了, 故之後的harmonic可略去不計,
6 ?% [/ b0 [2 V- E但是就是沒有17MHz的theoretical noise source.
( b) V) }. X: R" m. X來個Maxim AN928 anti-aliasing filter的文件:
% T1 ]# H! y0 k3 |
4 G& k: i6 n, V. v[ 本帖最後由 DennyT 於 2007-11-10 12:00 AM 編輯 ]

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 樓主| 發表於 2007-11-12 09:27:14 | 顯示全部樓層
Thank you for your kind reply.+ G6 m0 |0 f- y' ^
I have ever seen a paper or something else to say that when the signal frequency approaches the sample rate, the beat frequency is easy to appear at Fsig-Fs/2, for example, this frequency is 17MHz. It is as if sampling frequency is 27MHz. It is really a puzzle.

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發表於 2007-11-12 22:26:16 | 顯示全部樓層

ADC envelope test

有此一說:
+ u9 H* x: |4 z6 w當Fin接近於Fs/2時, ADC sample的電壓slew at full scale, 此時奇數點之間的壓差其實很小 (偶數點亦同), 但是相鄰兩點間的壓差卻很大, 測試上又稱為ADC envelope test, 而在此測試中被引進來的 "beat frequency" 會被視為noise, 使SNR下降.
) U" ^' l, J  X# f5 O! x% j, y( ^; p8 V# f! `0 E  \. X
也就是說, 若ADC內front end的PGA or buffer Amp slew rate不足, 此缺陷便很容易在此測試中被突顯出來.
1 Z3 E4 r& d9 K. m$ e" b1 U" p6 L
就系統面而言, 拉高ADC的AVDD看看有沒有救, (ADC PAD_VDD反而要調低, 除了降EMI外也可拉低系統noise floor)./ g; ^. B% D8 l. B& U0 B

; X5 Y' r' ~; R( {[ 本帖最後由 DennyT 於 2007-11-12 10:29 PM 編輯 ]

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 樓主| 發表於 2007-11-16 15:32:20 | 顯示全部樓層
I am really thankful to DennyT's reply, it is a reasonable and constructive explanation on this issue. I will try to pull higher supply voltage to see if it can be relieved or removed or not. Thank you very much.
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